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资料编号:52616
 
资料名称:AD5544ARS
 
文件大小: 473.61K
   
说明
 
介绍:
Quad, Current-Output Serial-Input, 16-Bit/14-Bit DACs
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
rev. 0
–4–
ad5544/ad5554–specifications
ad5554 电的 特性
参数 标识 情况 最小值 典型值 最大值 单位
静态的 效能
1
决议 N 1 lsb = v
REF
/2
14
= 610
µ
v 当 v
REF
= 10 v 14
相关的 精度 INL
±
1 LSB
差别的 非线性 DNL
±
1 LSB
输出 泄漏 电流 I
输出
X 数据 = 0000
H
, t
一个
= 25
°
C10nA
I
输出
X 数据 = 0000
H
, t
一个
= t
一个
最大值 20 nA
全部-规模 增益 错误 G
FSE
数据 = 3fff
H
±
2
±
10 mV
全部-规模 tempco
2
TCV
FS
1 ppm/
°
C
反馈 电阻 R
FB
XV
DD
= 5 v 4 6 8 k
涉及 输入
V
REF
x 范围 V
REF
X –15 +15 V
输入 阻抗 R
REF
X468k
输入 阻抗 相一致 R
REF
X 频道-至-频道 1 %
输入 电容
2
C
REF
X5pF
相似物 输出
输出 电流 I
输出
X 数据 = 3fff
H
1.25 2.5 毫安
输出 电容
2
C
输出
X 代号-依赖 80 pF
逻辑 输入 和 输出
逻辑 输入 低 电压 V
IL
0.8 V
逻辑 输入 高 电压 V
IH
2.4 V
输入 泄漏 电流 I
IL
1
µ
一个
输入 电容
2
C
IL
10 pF
逻辑 输出 低 电压 V
OL
I
OL
= 1.6 毫安 0.4 V
逻辑 输出 高 电压 V
OH
I
OH
= 100
µ
A4V
接口 定时
2, 3
时钟 宽度 高 t
CH
25 ns
时钟 宽度 低 t
CL
25 ns
CS
至 时钟 建制 t
CSS
0ns
时钟 至
CS
支撑 t
CSH
25 ns
时钟 至 sdo prop 延迟 t
PD
220ns
加载 dac pulsewidth t
LDAC
25 ns
数据 建制 t
DS
20 ns
数据 支撑 t
DH
20 ns
加载 建制 t
LDS
5ns
加载 支撑 t
LDH
25 ns
供应 特性
电源 供应 范围 V
dd 范围
4.5 5.5 V
积极的 供应 电流 I
DD
逻辑 输入 = 0 v 50 250
µ
一个
负的 供应 电流 I
SS
逻辑 输入 = 0 v, v
SS
= –5 v 0.001 1
µ
一个
电源 消耗 P
DISS
逻辑 输入 = 0 v 1.25 mW
电源 供应 敏锐的 PSS
V
DD
=
±
5% 0.006 %/%
注释:
1
所有 静态的 效能 tests (除了 i
输出
) 是 执行 在 一个 关闭-循环 系统 使用 一个 外部 精确 op177 i-至-v 转换器 amplifier. 这 ad5554
R
FB
终端 是 系 至 这 amplifier 输出. 典型 值 代表 平均 readings 量过的 在 25
°
c.
2
这些 参数 是 有保证的 用 设计 和 不 主题 至 生产 测试.
3
所有 输入 控制 信号 是 specified 和 t
R
= t
F
= 2.5 ns (10% 至 90% 的 3 v) 和 安排时间 从 一个 电压 水平的 的 1.5 v.
specifications 主题 至 改变 没有 注意.
(@ v
DD
= 5 v
10%, v
SS
= 0 v, i
输出
x = 模拟的 地, 一个
x = 0 v,
V
REF
一个, b, c, d = 10 v, t
一个
= 全部 运行 温度 范围,
除非 否则 指出.)
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