ADS5271IPFPT_集成电路资料查询网


sbas313a −六月 2004 − 修订 六月 2004
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4
交流 特性
T
最小值
= −40
°
c, t
最大值
= +85
°
c. 典型 值 是 在 t
一个
= 25
°
c, 时钟 频率 = 最大 指定, 50% 时钟 职责 循环, avdd = 3.3v,
lvdd = 3.3v, −1dbfs, 内部的 电压 涉及, 和 lvds 缓存区 电流 在 3.5ma 每 channel, 除非 否则 noted.
ADS5271
参数 情况 最小值 典型值 最大值 单位
动态 特性
f
在
= 1mhz 87 dBc
SFDR spurious-自由 动态 范围
f
在
= 5mhz 78 85 dBc
SFDR spurious-自由 动态 范围
f
在
= 10mhz 84 dBc
f
在
= 20mhz 82 dBc
f
在
= 1mhz 90 dBc
HD
2
2nd-顺序 调和的 扭曲量
f
在
= 5mhz 85 90 dBc
HD
2
2nd-顺序 调和的 扭曲量
f
在
= 10mhz 87 dBc
f
在
= 20mhz 85 dBc
f
在
= 1mhz 87 dBc
HD
3
3rd-顺序 调和的 扭曲量
f
在
= 5mhz 78 85 dBc
HD
3
3rd-顺序 调和的 扭曲量
f
在
= 10mhz 84 dBc
f
在
= 20mhz 82 dBc
f
在
= 1mhz 70.5 dBFS
SNR 信号-至-噪音 比率
f
在
= 5mhz 68 70.5 dBFS
SNR 信号-至-噪音 比率
f
在
= 10mhz 70.5 dBFS
f
在
= 20mhz 70.5 dBFS
f
在
= 1mhz 70 dBFS
SINAD 信号-至-噪音 和 扭曲量
f
在
= 5mhz 67.5 70 dBFS
SINAD 信号-至-噪音 和 扭曲量
f
在
= 10mhz 70 dBFS
f
在
= 20mhz 70 dBFS
ENOB 有效的 号码 的 位 f
在
= 5mhz 11.3 位
串扰
信号 应用 至 7 途径;
度量 带去 在这 频道 和
非 输入 信号
−90 dBc
lvds 数字的 数据 和 时钟 输出
测试 情况 在 i
O
= 3.5ma, r
加载
= 100
Ω
, 和 c
加载
= 9pf. i
O
谈及 至 这 电流 设置 为 这 lvds 缓存区. r
加载
是 这 差别的 加载 阻抗
在 这 差别的 lvds 一双. c
加载
是 这 有效的 单独的-结束 加载 电容 在 这 差别的 lvds 管脚 和 地面. c
加载
包含 这
接受者 输入 parasitics 作 好 作 这 routing parasitics. 度量 是 完毕 和 一个 传递 线条 的 100
Ω
差别的 阻抗 在 这 设备 和
这 加载. 所有 lvds规格 是 functionally 测试, 但是 不 parametrically 测试.
参数 情况 最小值 典型值 最大值 单位
直流 规格
(1)
V
OH
输出 电压 高, 输出
P
或者 输出
N
R
加载
= 100
Ω
±
1%; 看 lvds 定时 图解, 页 7 1375 1500 mV
V
OL
输出 电压 低, 输出
P
或者 输出
N
R
加载
= 100
Ω
±
1% 900 1025 mV

V
OD

输出 差别的 电压,

输出
P
或者 输出
N

R
加载
= 100
Ω
±
1% 300 350 400 mV
V
OS
输出 补偿 电压
(2)
R
加载
= 100
Ω
±
1%; 看 lvds 定时 图解, 页 7 1100 1200 1300 mV
C
O
输出 电容
(3)
V
CM
= 1.0v 和 1.4v 4 pF

∆
V
OD

改变 在

V
OD

在 0 和 1 R
加载
= 100
Ω
±
1% 25 mV
∆
V
OS
改变 在 0 和 1 R
加载
= 100
Ω
±
1% 25 mV
ISOUT 输出 短的-电路 电流 驱动器 短接 至 地面 40 毫安
ISOUT
NP
输出 电流 驱动器 短接 一起 12 毫安
驱动器 交流规格
时钟 时钟 信号 职责 循环 6
×
ADCLK 45 50 55 %
最小 数据 建制 时间
(4,
5)
400 ps
最小 数据 支撑 时间
(4,
5)
400 ps
t
上升
/t
下降
V
OD
上升 时间 或者 v
OD
下降 时间 I
O
= 2.5ma 400
I
O
= 3.5ma 250 ps
I
O
= 4.5ma 200 ps
I
O
= 6ma 150 ps
(1)
这 直流 规格 谈及 至 这 情况 在哪里 这 lvds 输出 是 不 切换, 但是 是 permanently 在 一个 有效的 逻辑 level 0 或者 1.
(2)
V
OS
谈及 至 这 一般模式 的 输出
P
和 输出
N
.
(3)
输出 电容 inside 这 设备, 从 也 输出
P
或者 输出
N
至 地面.
(4)
谈及 至 这 lvds 应用 便条 (sbaa118)为 一个 描述 的 数据 建制 和 支撑 时间.
(5)
建制 和 支撑 时间 规格 引领 在 账户 这 效应 的 jitter 在 这 输出 数据 和 时钟. 这些 规格 al所以 假设 那 这 数据 和 时钟
paths 是 perfectly matched 在里面 这 接受者. 任何 mismatch 在 这些 paths 在里面 这 接受者 将 呈现 作 减少 定时margins.

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 sbas313a −六月 2004 − 修订六月 2004 www.德州仪器.com 4 交流特性 T 最小值 = −40 ° c, t 最大值 = +85 ° c. 典型值是在 t 一个 = 25 ° c, 时钟频率 = 最大指定, 50% 时钟职责循环, avdd = 3.3v, lvdd = 3.3v, −1dbfs, 内部的电压涉及, 和 lvds 缓存区电流在 3.5ma 每 channel, 除非否则 noted. ADS5271 参数情况最小值典型值最大值单位动态特性 f 在 = 1mhz 87 dBc SFDR spurious-自由动态范围 f 在 = 5mhz 78 85 dBc SFDR spurious-自由动态范围 f 在 = 10mhz 84 dBc f 在 = 20mhz 82 dBc f 在 = 1mhz 90 dBc HD 2 2nd-顺序调和的扭曲量 f 在 = 5mhz 85 90 dBc HD 2 2nd-顺序调和的扭曲量 f 在 = 10mhz 87 dBc f 在 = 20mhz 85 dBc f 在 = 1mhz 87 dBc HD 3 3rd-顺序调和的扭曲量 f 在 = 5mhz 78 85 dBc HD 3 3rd-顺序调和的扭曲量 f 在 = 10mhz 84 dBc f 在 = 20mhz 82 dBc f 在 = 1mhz 70.5 dBFS SNR 信号-至-噪音比率 f 在 = 5mhz 68 70.5 dBFS SNR 信号-至-噪音比率 f 在 = 10mhz 70.5 dBFS f 在 = 20mhz 70.5 dBFS f 在 = 1mhz 70 dBFS SINAD 信号-至-噪音和扭曲量 f 在 = 5mhz 67.5 70 dBFS SINAD 信号-至-噪音和扭曲量 f 在 = 10mhz 70 dBFS f 在 = 20mhz 70 dBFS ENOB 有效的号码的位 f 在 = 5mhz 11.3 位串扰信号应用至 7 途径; 度量带去在这频道和非输入信号 −90 dBc lvds 数字的数据和时钟输出测试情况在 i O = 3.5ma, r 加载 = 100 Ω , 和 c 加载 = 9pf. i O 谈及至这电流设置为这 lvds 缓存区. r 加载是这差别的加载阻抗在这差别的 lvds 一双. c 加载是这有效的单独的-结束加载电容在这差别的 lvds 管脚和地面. c 加载包含这接受者输入 parasitics 作好作这 routing parasitics. 度量是完毕和一个传递线条的 100 Ω 差别的阻抗在这设备和这加载. 所有 lvds规格是 functionally 测试, 但是不 parametrically 测试. 参数情况最小值典型值最大值单位直流规格 (1) V OH 输出电压高, 输出 P 或者输出 N R 加载 = 100 Ω ± 1%; 看 lvds 定时图解, 页 7 1375 1500 mV V OL 输出电压低, 输出 P 或者输出 N R 加载 = 100 Ω ± 1% 900 1025 mV  V OD  输出差别的电压,  输出 P 或者输出 N  R 加载 = 100 Ω ± 1% 300 350 400 mV V OS 输出补偿电压 (2) R 加载 = 100 Ω ± 1%; 看 lvds 定时图解, 页 7 1100 1200 1300 mV C O 输出电容 (3) V CM = 1.0v 和 1.4v 4 pF  ∆ V OD  改变在  V OD  在 0 和 1 R 加载 = 100 Ω ± 1% 25 mV ∆ V OS 改变在 0 和 1 R 加载 = 100 Ω ± 1% 25 mV ISOUT 输出短的-电路电流驱动器短接至地面 40 毫安 ISOUT NP 输出电流驱动器短接一起 12 毫安驱动器交流规格时钟时钟信号职责循环 6 × ADCLK 45 50 55 % 最小数据建制时间 (4, 5) 400 ps 最小数据支撑时间 (4, 5) 400 ps t 上升 /t 下降 V OD 上升时间或者 v OD 下降时间 I O = 2.5ma 400 I O = 3.5ma 250 ps I O = 4.5ma 200 ps I O = 6ma 150 ps (1) 这直流规格谈及至这情况在哪里这 lvds 输出是不切换, 但是是 permanently 在一个有效的逻辑 level 0 或者 1. (2) V OS 谈及至这一般模式的输出 P 和输出 N . (3) 输出电容 inside 这设备, 从也输出 P 或者输出 N 至地面. (4) 谈及至这 lvds 应用便条 (sbaa118)为一个描述的数据建制和支撑时间. (5) 建制和支撑时间规格引领在账户这效应的 jitter 在这输出数据和时钟. 这些规格 al所以假设那这数据和时钟 paths 是 perfectly matched 在里面这接受者. 任何 mismatch 在这些 paths 在里面这接受者将呈现作减少定时margins.

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