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资料编号:5607
 
资料名称:DF1706E/2K
 
文件大小: 291.8K
   
说明
 
介绍:
Stereo, 24-Bit, 192kHz 8x Oversampling Digital Interpolation Filter
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
DF1706
6
SBAS182
系统 时钟 (所需的)东西
这 系统 时钟 的 这 df1706 能 是 有提供的 用 也 一个
外部 时钟 信号 在 xti (管脚 6), 或者 用 这 在-碎片 结晶
振荡器. 这 系统 时钟 比率 必须 run 在 128f
S
, 192f
S
,
256f
S
, 384f
S
, 512f
S
, 或者 768f
S
, 在哪里 f
S
是 这 音频的 抽样
比率. 当 一个 128f
S
或者 192f
S
系统 时钟 是 应用 至
df1706, 这 在-抽样 比率 (osr) 的 这 df1706's
数字的 过滤 应当 是 四 时间 instead 的 第八 时间. 这
osr 能 是 选择 用 这 x4 管脚 (管脚 21) 在 硬件 模式
或者 x4 位 在 模式 2 寄存器 在 软件 模式.
它 应当 是 指出 那 一个 768f
S
系统 时钟 不能 是 使用
当 f
S
是 大 比 48khz. 两个都 128f
S
和 192f
S
系统
时钟 能 是 使用 当 f
S
是 大 比 96khz. 在 增加,
这 在-碎片 结晶 振荡器 是 限制 至 一个 最大 fre-
quency 的 24.0mhz. 表格 i 显示 这 典型 系统 时钟
发生率 为 选择 样本 比率.
这 df1706 包含 一个 系统 时钟 发现 电路 那
确定 这 系统 时钟 比率 在 使用. 这 电路 比较
这 系统 时钟 输入 (xti) 频率 和 这 lrcin 输入
比率 至 决定 这 系统 时钟 乘法器. ideally, lrcin
和 bckin 应当 是 获得 从 这 系统 时钟 至
确保 恰当的 同步. 如果 这 阶段 区别 是-
tween 这 系统 时钟 和 lrcin 是 大 比
±
4 位 时钟
(bckin) 时期, 这 同步 的 这 系统 和
lrcin clocks 将 是 执行 automatically 用 这 df1706.
定时 (所需的)东西 为 这 系统 时钟 输入 是 显示 在
图示 1.
系统 时钟 频率 (mhz)
抽样 比率 频率 (f
S
)256f
S
128f
S
192f
S
256f
S
384f
S
512f
S
768f
S
32kHz n/一个 n/一个 8.192 12.288 16.384 24.576
(1)
44.1khz n/一个 n/一个 11.2896 16.934 22.5792 33.8688
(1)
48kHz n/一个 n/一个 12.288 18.432 24.576
(1)
36.864
(1)
88.2khz n/一个 n/一个 22.5792
(1)
33.8688
(1)
n/一个 n/一个
96kHz n/一个 n/一个 24.576 36.864
(1)
n/一个 n/一个
176.4khz 22.5792
(2)
33.8688
(1)(2)
n/一个 n/一个 n/一个 n/一个
192kHz 24.576
(1)(2)
36.864
(1)(2)
n/一个 n/一个 n/一个 n/一个
注释: (1) 结晶 振荡器 频率 使用 内部的 振荡器 是 不 covered 在 频率 大 比 24.0mhz. (2) x4 (pin 21) 应当 是 设置 至 high.
表格 i. 典型 系统 时钟 发生率.
图示 1. 系统 时钟 定时.
重置
这 df1706 有 两个都 一个 内部的 电源-在 重置 电路 和
一个 重置 管脚, rst (管脚 14), 为 供应 一个 外部 重置
信号. 这 内部的 电源-在 重置 是 执行 自动地-
cally 当 电源 是 应用 至 这 df1706, 作 显示 在
图示 2. 这 rst 管脚 能 是 使用 至 同步 这
df1706 和 一个 系统 重置 信号, 作 显示 在 图示 3.
在 这 电源-在 重置 时期 (1024 系统 clocks), 这
输出 的 bcko, dol, 和 dor 是 强迫 低 和 这
输出 的 wcko 是 强迫 高. 为 一个 外部 强迫 重置,
这 输出 的 bcko, dol, 和 dor 是 强迫 低 和 这
输出 的 wcko 是 强迫 高 在 这 initialization
时期 (1024 系统 clocks), 这个 occurs 之后 这 低-至-
高 转变 的 这 rst 管脚(看图示 3).
1024 系统 clocks
重置 重置 除去
V
CC
/v
DD
2.5v
2.8v
1.8v
内部的 重置
系统 时钟
图示 2. 内部的 电源-在 重置 定时.
t
SCKH
t
SCKL
2.0v
0.8v
系统 时钟
便条: (1) 为 f
S
= 96khz 和 sck = 256f
S
, t
SCKIH
= 14ns (最小值)
t
SCKIL
= 14ns (最小值)
为 f
S
96khz 和 sck = 256f
S
, t
SCKIH
= 20ns (最小值)
t
SCKIL
= 20ns (最小值)
标识 参数 最小值 最大值 单位
t
SCKH
System 时钟 脉冲波 宽度 高 12 ns
(1)
t
SCKL
系统 时钟 脉冲波 宽度 低 12 ns
(1)
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