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资料编号:566150
 
资料名称:QL2009
 
文件大小: 272.83K
   
说明
 
介绍:
3.3V and 5.0V pASIC? 2 FPGA Combining Speed, Density, Low Cost and Flexibility
 
 


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QL2009
3-44
交流 特性 在 vcc = 5v, ta = 25
°°
c (k = 1.00)
传播 延迟 取决于 在 routing, 输出, 加载 电容, 供应 电压, 接合面 temperature,
和 处理 变化. 这 交流 特性 是 一个 设计 手册 至 提供 最初的 定时 估计 在
名义上的 情况. worst 情况 估计 是 得到 当 名义上的 传播 延迟 是 multiplied
用 这 适合的 延迟 因素, k, 作 指定 在 这 延迟 因素 表格 (运行 范围). 这
碎片
/快
Tools
/快
工作
软件 包含 数据 薄板 交流 特性 在 这
设计 database 为 准确的 path 分析 或者 simulation 结果 下列的 放置 和 route.
逻辑 cells
输入-仅有的 cells
标识 参数
传播 延迟 (ns)
输出
[8]
123481224
tIN 高 驱动 输入 延迟 2.5 2.6 2.6 2.7 3.5 4.6 5.8
tINI 高 驱动 输入, 反相的 延迟 2.6 2.7 2.7 2.8 3.6 4.7 5.9
tISU 输入 寄存器 设置-向上 时间 4.8 4.8 4.8 4.8 4.8 4.8 4.8
tIH 输入 寄存器 支撑 时间 0.0 0.0 0.0 0.0 0.0 0.0 0.0
tlCLK 输入 寄存器 时钟 至 q 0.9 1.0 1.0 1.1 1.9 3.0 4.2
tlRST 输入 寄存器 重置 延迟 0.8 0.9 0.9 1.0 1.8 2.9 4.1
tlESU 输入 寄存器 时钟 使能 设置-向上 时间 4.1 4.1 4.1 4.1 4.1 4.1 4.1
tlEH 输入 寄存器 时钟 使能 支撑 时间 0.0 0.0 0.0 0.0 0.0 0.0 0.0
注释:
[8] 陈述 定时 为 worst 情况 传播 延迟 在 处理 变化 在 vcc=5.0v 和 ta=25
°
c.
乘以 用 这 适合的 延迟 因素, k, 为 速 等级, 电压 和 温度 settings 作
指定 在 这 运行 范围.
[9] 这些 限制 是 获得 从 一个 代表 选择 的 这 slowest paths 通过 这 pasic 2 逻辑
cell
包含 典型 网 延迟
. worst 情况 延迟 值 为 明确的 paths 应当 是 决定 从
定时 分析 的 your particular 设计.
标识 参数
传播 延迟 (ns)
输出
[8]
12348
tPD combinatorial 延迟 [9] 1.4 1.7 2.0 2.3 3.5
tSU 建制 时间 [9] 1.8 1.8 1.8 1.8 1.8
tH 支撑 时间 0.0 0.0 0.0 0.0 0.0
tCLK 时钟 至 q 延迟 0.8 1.1 1.4 1.7 2.9
tCWHI 时钟 高 时间 2.0 2.0 2.0 2.0 2.0
tCWLO 时钟 低 时间 2.0 2.0 2.0 2.0 2.0
tSET 设置 延迟 1.4 1.7 2.0 2.3 3.5
tRESET 重置 延迟 1.2 1.5 1.8 2.1 3.3
tSW 设置 宽度 1.9 1.9 1.9 1.9 1.9
tRW 重置 宽度 1.8 1.8 1.8 1.8 1.8
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