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资料编号:58834
 
资料名称:PSD854F2-70J
 
文件大小: 1180.57K
   
说明
 
介绍:
Flash In-System Programmable ISP Peripherals For 8-bit MCUs
 
 


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psd813f2, psd833f2, psd834f2, psd853f2, psd854f2
重置 48 I
resets i/o 端口, pld macrocells 和 一些 的 这 配置 寄存器. 必须 是 低
在 电源-向上.
PA0
PA1
PA2
PA3
PA4
PA5
PA6
PA7
29
28
27
25
24
23
22
21
i/o
这些 管脚 制造 向上 端口 一个. 这些 端口 管脚 是 configurable 和 能 有 这 下列的
功能:
mcu i/o – 写 至 或者 读 从 一个 标准 输出 或者 输入 端口.
cpld macrocell (mcellab0-7) 输出.
输入 至 这 plds.
latched 地址 输出 (看 表格6).
地址 输入. 为 例子, pa0-3 可以 是 使用 为 a0-a3 当 使用 一个 80c51xa 在
burst 模式.
作 这 数据 总线 输入 d0-d7 为 非-多路复用 地址/数据 总线 mcus.
d0/a16-d3/a19 在 m37702m2 模式.
附带的 i/o 模式.
便条:
pa0-pa3 能 仅有的 输出 cmos 信号 和 一个 选项 为 高 回转 比率. 不管怎样,
pa4-pa7 能 是 配置 作 cmos 或者 打开 流 输出.
PB0
PB1
PB2
PB3
PB4
PB5
PB6
PB7
7
6
5
4
3
2
52
51
i/o
这些 管脚 制造 向上 端口 b. 这些 端口 管脚 是 configurable 和 能 有 这 下列的
功能:
mcu i/o – 写 至 或者 读 从 一个 标准 输出 或者 输入 端口.
cpld macrocell (mcellab0-7 或者 mcellbc0-7) 输出.
输入 至 这 plds.
latched 地址 输出 (看 表格6).
便条:
pb0-pb3 能 仅有的 输出 cmos 信号 和 一个 选项 为 高 回转 比率.
不管怎样, pb4-pb7 能 是 配置 作 cmos 或者 打开 流 输出.
PC0 20 i/o
pc0 管脚 的 端口 c. 这个 端口 管脚 能 是 配置 至 有 这 下列的 功能:
mcu i/o – 写 至 或者 读 从 一个 标准 输出 或者 输入 端口.
cpld macrocell (mcellbc0) 输出.
输入 至 这 plds.
tms 输入
2
为 这 jtag 串行 接口.
这个 管脚 能 是 配置 作 一个 cmos 或者 打开 流 输出.
PC1 19 i/o
pc1 管脚 的 端口 c. 这个 端口 管脚 能 是 配置 至 有 这 下列的 功能:
mcu i/o – 写 至 或者 读 从 一个 标准 输出 或者 输入 端口.
cpld macrocell (mcellbc1) 输出.
输入 至 这 plds.
tck 输入
2
为 这 jtag 串行 接口.
这个 管脚 能 是 配置 作 一个 cmos 或者 打开 流 输出.
管脚 名字 管脚 类型 描述
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