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资料编号:593455
 
资料名称:S87C552-4A68
 
文件大小: 199.46K
   
说明
 
介绍:
Single-chip 8-bit microcontroller
 
 


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飞利浦 半导体 产品 规格
80c562/83c562单独的-碎片 8-位 微控制器
1992 jan 08
5
管脚 描述
MNEMONIC 管脚 非. 类型 名字 和 函数
V
DD
2 I
数字的 电源 供应:
开始 模数转换器 运作:
输入 开始 相似物 至 数字的 转换 (模数转换器 运作 能 也 是 started
用 软件).
PWM0 4 O
输出 0.
PWM1 5 O
输出 1.
EW 6 I
使能 看门狗 计时器:
端口 0:
端口 0 是 一个 8-位 打开-流 双向的 i/o 端口. 端口 0 管脚 那 有 1s 写 至 它们 float
和 能 是 使用 作 高-阻抗 输入. 端口 0 是 也 这 多路复用 低-顺序 地址 和 数据
总线 在 accesses 至 外部 程序 和 数据 记忆. 在 这个 应用 它 使用 强 内部的
拉-ups 当 发出 1s.
p1.0–p1.7 16–23 i/o
端口 1:
8-位 i/o 端口. alternate 功能 包含:
16–23 i/o
(p1.0–p1.7):
quasi-双向的 端口 管脚.
16–19 i/o
ct0i–ct3i (p1.0–p1.3):
俘获 计时器 输入 信号 为 计时器 t2.
20 I
t2 (p1.4):
t2 事件 输入
21 I
t2 计时器 重置 信号. rising 边缘 triggered.
p2.0–p2.7 39–46 i/o
端口 2:
8-位 quasi-双向的 i/o 端口.
alternate 函数: 高-顺序 地址 字节 为 外部 记忆 (a08–a15).
p3.0–p3.7 24–31 i/o
端口 3:
8-位 quasi-双向的 i/o 端口. alternate 功能 include:
24
rxd(p3.0):
串行 输入 端口.
25
外部 中断.
27
INT1(p3.3):
外部 中断.
28
t0 (p3.4):
计时器 0 外部 输入.
29
t1 (p3.5):
计时器 1 外部 输入.
30
WR(p3.6):
外部 数据 记忆 写 strobe.
31
RD(p3.7):
外部 数据 记忆 读 strobe.
p4.0–p4.7 7–14 i/o
端口 4:
8-位 quasi-双向的 i/o 端口. alternate 功能 include:
7–12 O
cmsr0–cmsr5 (p4.0–p4.5):
计时器 t2 对比 和 设置/重置 输出 在 一个 相一致 和 计时器 t2.
13, 14 O
计时器 t2 对比 和 toggle 输出 在 一个 相一致 和 计时器 t2.
p5.0–p5.7 68–62,
1
I
端口 5:
8-位 输入 端口.
adc0–adc7 (p5.0–p5.7):
alternate 函数: 第八 输入 途径 至 模数转换器.
RST 15 i/o
重置:
输入 至 重置 这 87c552. 它 也 提供 一个 重置 脉冲波 作 输出 当 计时器 t3 overflows.
XTAL1 35 I
结晶 输入 1:
输入 至 这 反相的 放大器 那 形式 这 振荡器, 和 输入 至 这 内部的 时钟
发生器. receives 这 外部 时钟 信号 当 一个 外部 振荡器 是 使用.
XTAL2 34 O
结晶 输入 2:
输出 的 这 反相的 放大器 那 形式 这 振荡器. left open–circuit 当 一个
外部 时钟 是 使用.
V
SS
36, 37 I
数字的 地面.
PSEN 47 O
起作用的-低 读 strobe 至 外部 程序 记忆.
ALE 48 O
地址 获得 使能:
latches 这 低 字节 的 这 地址 在 accesses 至 外部 记忆. 它 是
使活动 每 六 振荡器 时期. 在 一个 外部 数据 记忆 进入, 一个 ale 脉冲波 是
skipped. ale 能 驱动 向上 至 第八 ls ttl 输入 和 handles cmos 输入 没有 一个 外部
拉-向上.
EA 49 I
外部 进入:
当 ea是 使保持 在 ttl 水平的 高, 这 cpu executes 输出 的 这 内部的 程序
只读存储器 提供 这 程序 计数器 是 较少 比 8192. 当 ea
是 使保持 在 ttl 低 水平的, 这 cpu
是 不 允许 至 float.
AV
REF–
58 I
低-终止.
AV
REF+
59 I
高-终止.
AV
SS
60 I
相似物 电源 供应
便条:
1. 至 避免 “latch-up” 效应 在 电源-在, 这 电压 在 任何 管脚 在 任何 时间 必须 不 是 高等级的 或者 更小的 比 v
DD
+0.5v 或者 v
SS
– 0.5v,
各自.
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