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资料编号:6067
 
资料名称:ADS7807PB
 
文件大小: 524.21K
   
说明
 
介绍:
Low-Power 16-Bit Sampling CMOS ANALOG-to-DIGITAL CONVERTER
 
 


: 点此下载
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ADS7807
9
SBAS022B
www.德州仪器.com
时钟 脉冲波. 作 一个 结果, 数据 能 是 读 在 这 并行的 端口
较早的 至 读 这 一样 数据 在 这 串行 端口, 但是 数据
不能 是 读 通过 这 串行 端口 较早的 至 读 这
一样 数据 在 这 并行的 端口.
并行的 输出
至 使用 这 并行的 输出, 系
ext/int
(管脚 8) 高 和
dataclk (管脚 18) 低. sdata (管脚 19) 应当 是 left
unconnected. 这 并行的 输出 将 是 起作用的 当
r/c
(管脚
22) 是 高 和
CS
(管脚 23) 是 低. 任何 其它 结合体
CS
r/c
将 触发-状态 这 并行的 输出. 有效的 变换器-
sion 数据 能 是 读 在 二 8-位 字节 在 d7-d0 (管脚 9-13
和 15-17). 当 字节 (管脚 21) 是 低, 这 8 大多数 signifi-
cant 位 将 是 有效的 和 这 msb 在 d7. 当 字节 是
高, 这 8 least 重大的 位 将 是 有效的 和 这 lsb 在
d0. 字节 能 是 toggled 至 读 两个都 字节 在里面 一个
转换 循环.
在之上 最初的 电源 向上, 这 并行的 输出 将 包含 indeter-
minate 数据.
图示 3. 使用
CS
至 控制 转换 和 读 定时 和 并行的 输出.
图示 2. 转换 定时 和 并行的 输出 (
CS
和 dataclk 系 低,
ext/int
系 高).
并行的 输出 (之后 一个 转换)
之后 转换
n
是 完成 和 这 输出 寄存器
有 被 updated,
BUSY
(管脚 24) 将 go 高. 有效的 数据
从 转换
n
将 是 有 在 d7-d0 (管脚 9-13 和
15-17).
BUSY
going 高 能 是 使用 至 获得 这 数据. 谈及
至 表格 v 和 计算数量 2 和 3 为 定时 constraints.
并行的 输出 (在 一个 转换)
之后 转换
n
有 被 initiated, 有效的 数据 从 con-
版本
n
1
能 是 读 和 将 是 有效的 向上 至 12
µ
s 之后
这 开始 的 转换
n
. 做 不 attempt 至 读 数据
在之外 12
µ
s 之后 这 开始 的 转换
n
直到
BUSY
(管脚
24) 变得 高; 这个 将 结果 在 读 invalid 数据. 谈及
至 表格 v 和 计算数量 2 和 3 为 定时 constraints.
t
10
BUSY
r/c
模式
Acquire
转变
t
11
t
7
t
6
t
3
t
4
t
1
Acquire 转变
t
8
t
6
t
3
并行的
数据 总线
Previous
高 字节 有效的
t
12
hi-z 不 有效的
t
2
t
9
高 字节
有效的
t
12
t
9
t
12
字节
t
1
previous 低
字节 有效的
previous 高
字节 有效的
低 字节
有效的
高 字节
有效的
t
12
hi-z
t
12
t
12
t
5
hi-z 状态
BUSY
r/c
数据
总线
高 字节
t
3
t
4
t
21
t
21
t
1
t
21
t
21
字节
t
21
t
21
t
21
t
21
t
21
t
21
hi-z 状态 低 字节 hi-z 状态
t
9
t
12
t
9
t
12
CS
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