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资料编号:61467
 
资料名称:AD7524JP
 
文件大小: 162.2K
   
说明
 
介绍:
CMOS 8-Bit Buffered Multiplying DAC
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
AD7524
rev. b
–4–
写 模式
CS
WR
是 两个都 低, 这 ad7524 是 在 这
写 模式, 和 这 ad7524 相似物 输出 responds 至 数据
activity 在 这 db0–db7 数据 总线 输入. 在 这个 模式, 这
ad7524 acts 像 一个 nonlatched 输入 d/一个 转换器.
支撑 模式
当 也
CS
或者
WR
是 高, 这 ad7524 是 在 这 支撑
模式. 这 ad7524 相似物 输出 holds 这 值 correspond-
ing 至 这 last 数字的 输入 呈现 在 db0–db7 较早的 至
WR
或者
CS
假设 这 高 状态.
模式 选择 表格
CS WR
模式 dac 回馈
L L dac responds 至 数据 总线
(db0–db7) 输入.
H X 支撑 数据 总线 (db0–db7) 是
锁 输出:
X H 支撑 dac holds last 数据 呈现
WR
或者
CS
assumed
高 状态.
l = 低 状态, h = 高 状态, x = don't 小心.
图示 3. 供应 电流 vs. 逻辑 水平的
典型 plots 的 供应 电流, i
DD
, 相比 逻辑 输入 电压,
V
, 为 v
DD
= +5 v 和 v
DD
= +15 v 是 显示 在之上.
电路 描述
电路 信息
这 ad7524, 一个 8-位 乘以 d/一个 转换器, 组成 的 一个
高级地 稳固的 薄的 影片 r-2r ladder 和 第八 n-频道 电流
switches 在 一个 大而单一的 碎片. 大多数 产品 需要 这
增加 的 仅有的 一个 输出 运算的 放大器 和 一个 电压
或者 电流 涉及.
这 simplified d/一个 电路 是 显示 在 图示 1. 一个 inverted
r-2r ladder 结构 是 used—that 是, 这 binarily weighted
电流 是 切换 在 这 out1 和 out2 总线 线条,
因此 维持 一个 常量 电流 在 各自 ladder leg indepen-
dent 的 这 转变 状态.
图示 1. 函数的 图解
相等的 电路 分析
这 相等的 电路 为 所有 数字的 输入 低 是 显示 在
计算数量 2. 在 图示 2 和 所有 数字的 输入 低, 这 谈及-
ence 电流 是 切换 至 out2. 这 电流 源 i
泄漏
是 composed 的 表面 和 接合面 leakages 至 这 基质
当 这
1
256
电流 源 代表 一个 常量 1-位 cur-
rent 流 通过 这 末端 电阻 在 这 r-2r ladder.
这 “on” 电容 的 这 输出 n-频道 switches 是
120 pf, 作 显示 在 这 out2 终端. 这 “off” 转变
电容 是 30 pf, 作 显示 在 这 out1 终端. 分析
的 这 电路 为 所有 数字的 输入 高 是 类似的 至 图示 2
不管怎样, 这 “on” switches 是 now 在 终端 out1, hence
这 120 pf 呈现 在 那 终端.
图示 2. ad7524 dac 相等的 circuit—all 数字的
输入 低
接口 逻辑 信息
模式 选择
ad7524 模式 选择 是 控制 用 这
CS
WR
输入.
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