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资料编号:626678
 
资料名称:STLC3065
 
文件大小: 194.47K
   
说明
 
介绍:
WLL SUBSCRIBER LINE INTERFACE CIRCUIT
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
函数的 描述
STLC3065 一个 设备 specifically 开发
WLL 应用.
为基础 一个 SLIC 核心, 目的 optimised
这个 应用, 增加 一个 直流/直流
转换器 控制 一个 端口 顺序 ful-
fil WLL (所需的)东西.
SLIC 核心 执行 标准 feeding,
signalling 传递 功能.
设置 不同的 运行 模式
通过 d0, d1, D2 管脚 控制 逻辑 inter-
面向 (0 3.3v 逻辑 水平). 循环 状态
carried 输出 DET 管脚 (起作用的 低).这 DET
管脚 一个 打开 输出 准许 容易 interfac-
ing 两个都 3.3v 5V 逻辑 水平.
可能 SLIC 核心 运行 模式
是:
电源 向下 (pwd)
起作用的
Ringing
表格 1 显示 如何 设置 不同的 SLIC 核心
运行 模式.
表格 1. SLIC 核心 运行 模式.
D0 D1 D2 运行 模式
0 0 X 电源 向下
0 1 0 起作用的 正常的 极性
0 1 1 起作用的 反转 极性
1 1 0 起作用的 TTX injection (n.p.)
1 1 1 起作用的 TTX injection (r.p.)
1 0 0/1 环绕 (d2 toggles @ fring)
n. 名字 Function
35 VBAT 管制 电池 电压 发生 设备 通过 直流/直流 转换器. 必须 短接
vbat1.
23 驱动器 外部 电源 MOS 晶体管.
21 VF 反馈 输入 直流/直流 转换器 控制.
22 CLK 电源 转变 控制 时钟 (典型值. 125khz). 版本 marked STLC3065 a5, 这个 管脚
连接 CVCC 或者 agnd. CLK 管脚 连接 CVCC 一个
内部的 自动-振动 内部 发生 使用 instead 外部 时钟.
CLK 管脚 连接 agnd, 输出 无能.
24 RSENSE 电压 输入 电流 感觉到. RSENSE 应当 连接 关闭 这个 管脚 VPOS
管脚. PCB 布局 应当 降低 extra 阻抗 introduced 轨道.
1 D0 控制 接口: 输入 0.
2 D1 控制 接口: 输入 1.
3 D2 控制 接口: 输入 2.
4 P1 控制 接口: 端口 1 选择
5 P2 控制 接口: 端口 2 选择
8 DET 逻辑 接口 输出 supervision 探测器 (起作用的 低).
6 DET1 逻辑 接口 输出 thr linr 端口 1 探测器 (起作用的 低)
7 DET2 逻辑 接口 输出 thr linr 端口 2 探测器 (起作用的 低)
33 CSVR 电池 供应 过滤 电容.
12 RTTX Metering 脉冲波 cancellation 缓存区 输出. TTX 过滤 网络 应当 连接 这个 要点.
如果 使用 应当 left 打开.
13 FTTX Metering 脉冲波 缓存区 输入 这个 信号 sent 线条 使用 执行 TTX 过滤.
10 CTTX1 Metering burst shaping 外部 电容.
11 CTTX2 Metering burst shaping 外部 电容.
9 CKTTX Metering 脉冲波 时钟 输入 (12 KHz 或者 16KHz 正方形的 波).
44 VBAT1 框架 连接. 必须 短接 vbat.
38,39,
40
NC 连接.
管脚 描述
(持续)
STLC3065
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