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thc63lvd104a rev.1.0
THine
管脚 描述
** rxn
x = 一个,b,c,d,e
n = 0,1,2,3,4,5,6
管脚 名字 管脚 # 类型 描述
ra+, ra- 50, 49 lvds 在
lvds 数据 在.
rb+, rb- 52, 51 lvds 在
rc+, rc- 55, 54 lvds 在
rd+, rd- 60, 59 lvds 在
re+,re- 62, 61 lvds 在
rclk+, rclk- 57, 56 lvds 在 lvds 时钟 在.
ra6 ~ ra0 40,41,42,43,45,46,47 输出
cmos/ttl 数据 输出.
rb6 ~ rb0 32,33,34,35,36,38,39 输出
rc6 ~ rc0 22,24,25,26,27,28,29 输出
rd6 ~ rd0 14,15,17,18,19,20,21 输出
re6 ~ re0 6,7,8,10,11,12,13 输出
测试 2 在 测试 管脚, 必须 是 “l” 为 正常的 运作.
PD 3 在
h: 正常的 运作,
l: 电源 向下 (所有 输出 是 “l”)
OE 4 在
h:输出 使能 (正常的 运作).
l:输出 使不能运转(所有 输出 是 hi-z)
r/f 5 在
输出 时钟 triggering 边缘 选择.
h: rising 边缘, l: 下落 边缘
VCC 9,23,37,48 电源
电源 供应 管脚 为 ttl 输出 和 数字的
电路系统.
CLKOUT 31 输出 时钟 输出.
地 1,16,30,44 地面
地面 管脚 为 ttl 输出 和 数字的 cir-
cuitry.
LVCC 53 电源 电源 供应 管脚 为 lvds 输入.
LGND 58 地面 地面 管脚 为 lvds 输入.
PVCC 64 电源 电源 供应 管脚 为 pll 电路系统.
PGND 63 地面 地面 管脚 为 pll 电路系统.
PD r/f OE
数据 输出
(rxn)
CLKOUT
00 0 hi-z hi-z
0 0 1 所有 0 fixed 低
01 0 hi-z hi-z
0 1 1 所有 0 fixed 低
10 0 hi-z hi-z
1 0 1 数据 输出 它 latches 输出 数据 在 下落 边缘.
11 0 hi-z hi-z
1 1 1 数据 输出 它 latches 输出 数据 在 rising 边缘.
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