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资料编号:647392
 
资料名称:THC63LVD823
 
文件大小: 227.6K
   
说明
 
介绍:
Single(135MHz)/Dual(170MHz) Link LVDS Transmitter for SXGA/SXGA+/UXGA
 
 


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thine electronics, 公司
thc63lvd823 _rev2.0
管脚 描述
管脚 名字 管脚 # 类型 描述
ta1+, ta1- 48, 49 lvds 输出
这 1st link. 这 1st pixel 输出 数据 当 双 link.
tb1+, tb1- 46, 47 lvds 输出
tc1+, tc1- 43, 44 lvds 输出
td1+, td1- 39, 40 lvds 输出
tclk1+, tclk1- 41, 42 lvds 输出 lvds 时钟 输出 为 1st link.
ta2+, ta2- 36, 37 lvds 输出
这 2nd link. 这些 管脚 是 无能 当 单独的 link.
tb2+, tb2- 34, 35 lvds 输出
tc2+, tc2- 31, 32 lvds 输出
td2+, td2- 27, 28 lvds 输出
tclk2+, tclk2- 29, 30 lvds 输出 lvds 时钟 输出 为 2nd link.
r17 ~ r10
60, 59, 58, 57,
54, 53, 52, 51
这 1st pixel 数据 输入.g17 ~ g10
68, 67, 66, 65,
64, 63, 62, 61
b17 ~ b10
78, 77, 76, 75,
74, 73, 70, 69
r27 ~ r20
86, 85, 84, 83,
82, 81, 80, 79
这 2nd pixel 数据 输入.g27 ~ g20
96, 95, 94, 93,
92, 91, 90, 89
b27 ~ b20
6, 5, 2, 1, 100,
99, 98, 97
DE 9 数据 使能 输入.
VSYNC 8 vsync 输入.
HSYNC 7 hsync 输入.
CLKIN 10 时钟 输入.
test1, test5 13, 22 输出 测试 管脚.
test3, test4 20, 21 测试 管脚, 必须 是 l 为 正常的 运作.
TEST2 14 测试 管脚, 必须 是 h 为 正常的 运作.
/pdwn 19
h: 正常的 运作,
l: 电源 向下 (所有 输出 是 hi-z)
6/8 18
6bit/8bit 颜色 选择.
h: 6bit (tdx+/- 是 地), l: 8bit.
OE 17
输出 使能.
h: 输出 使能, l: 输出 使不能运转 (所有 输出 是 hi-z)
mode1, mode0 15, 16
RS 12
lvds 摆动 范围 选择.
h: 正常的 范围, l: 减少 范围.
pixel 数据 模式.
MODE1 MODE0 模式
L L 双 link (双-在/双-输出)
L H 单独的 link (双-在/单独的-输出)
H H 单独的 link (单独的-在/单独的-输出)
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