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资料编号:653170
 
资料名称:TLV1572ID
 
文件大小: 192.41K
   
说明
 
介绍:
2.7 V TO 5.5 V, 10-BIT, 1.25 MSPS SERIAL ANALOG-TO-DIGITAL CONVERTER WITH AUTO-POWERDOWN
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
TLV1572
2.7 v 至 5.5 v, 10-位, 1.25 msps
串行 相似物-至-数字的 转换器 和 自动-powerdown
slas171a – 12月 1997– 修订 九月 1998
5
邮递 办公室 盒 655303
达拉斯市, 德州 75265
电的 特性 在 推荐 运行 自由-空气 温度 范围, v
CC
= 5 v,
V
REF
= 5 v, f
SCLK
= 20 mhz (除非 否则 指出) (持续)
交流 规格
参数 测试 情况 最小值 典型值 最大值 单位
信号-至-噪音 比率 + 扭曲量 f
(输入)
= 200 khz 54 58 dB
THD 总的 调和的 扭曲量 f
(输入)
= 200 khz 56 60 dB
有效的 号码 的 位 f
(输入)
= 200 khz 8.7 9.35
spurious-自由 动态 范围 f
(输入)
= 200 khz 57 62 dB
相似物 输入
BW 全部-电源 带宽 源 阻抗 = 1 k
12 MHz
BW 小-信号 带宽 源 阻抗 = 1 k
20 Mhz
定时 规格
参数 测试 情况 最小值 典型值 最大值 单位
t
c
sclk 时期 V
CC
= 4.5 v – 5.5 v 50 ns
t
c
sclk 时期 V
CC
= 2.7 v – 3.3 v 100 ns
t
rs
重置 和 抽样 时期 6
SLCK
循环
t
c
转换 时期 10
SLCK
循环
t
su1
fs 建制 时间 至 sclk 下落 边缘 在 dsp 模式 10 ns
t
h1
fs 支撑 时间 至 sclk 下落 边缘 在 dsp 模式 4 ns
t
su2
fs 建制 时间 至 cs下落 边缘 在 dsp 模式 6 ns
t
h2
fs 支撑 时间 至 cs下落 边缘 在 dsp 模式 9 ns
t
d1
输出 延迟 之后 sclk rising 边缘 在 dsp 模式 15 25 ns
t
d(l)1
fs 下落 边缘 至 next sclk 下落 边缘 在 dsp 模式 6 ns
t
d(l)2
sclk rising 边缘 之后 cs下落 边缘 在
µ
c 模式 4 ns
t
d2
输出 延迟 之后 sclk rising 边缘 在
µ
c 模式 15 25 ns
规格 主题 至 改变 没有 注意.
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