飞利浦 半导体 产品 规格
74LVT16373A3.3v 16-位 transparent d-类型 获得 (3-state)
1998 二月 19
5
直流 电的 特性
限制
标识 参数 测试 情况 温度 = -40
°
c 至 +85
°
C 单位
最小值 典型值
1
最大值
V
IK
输入 clamp 电压 V
CC
= 2.7v; i
IK
= –18ma –.85 –1.2 V
V
CC
= 2.7 至 3.6v; i
OH
= –100
µ
一个 V
CC
-0.2 V
CC
V
OH
高-水平的 输出 电压 V
CC
= 2.7v; i
OH
= –8ma 2.4 2.5 V
V
CC
= 3.0v; i
OH
= –32ma 2.0 2.3
V
CC
= 2.7v; i
OL
= 100
µ
一个 0.07 0.2
V
CC
= 2.7v; i
OL
= 24ma 0.3 0.5
V
OL
low–level 输出 电压 V
CC
= 3.0v; i
OL
= 16ma 0.25 0.4 V
V
CC
= 3.0v; i
OL
= 32ma 0.3 0.5
V
CC
= 3.0v; i
OL
= 64ma 0.4 0.55
V
RST
电源-向上 输出 低 电压
5
V
CC
= 3.6v; i
O
= 1ma; v
I
= 地 或者 v
CC
0.1 0.55 V
V
CC
= 3.6v; v
I
= v
CC
或者 地 控制 管脚 0.1
±
1
I
I
输入 泄漏 电流
V
CC
= 0 或者 3.6v; v
I
= 5.5v 0.4 10
µ
AI
I
在 ut 泄漏 电流
V
CC
= 3.6v; v
I
= v
CC
数据 管脚
4
0.1 1
µ
一个
V
CC
= 3.6v; v
I
= 0
数据 ins
4
-0.4 -5
I
止
输出 止 电流 V
CC
= 0v; v
I
或者 v
O
= 0 至 4.5v 0.1
±
100
µ
一个
7
V
CC
= 3v; v
I
= 0.8v 75 135
I
支撑
总线 支撑 电流 d 输入
7
V
CC
= 3v; v
I
= 2.0v –75 -135
µ
一个
V
CC
= 0v 至 3.6v; v
CC
= 3.6v
±
500
I
EX
电流 在 一个 输出 在 这
高 状态 当 v
O
> v
CC
V
O
= 5.5v; v
CC
= 3.0v 50 125
µ
一个
I
pu/pd
电源 向上/向下 3-状态 输出
电流
3
V
CC
≤
1.2v; v
O
= 0.5v 至 v
CC
; v
I
= 地 或者 v
CC
;
oe/oe= don’t 小心
1
±
100
µ
一个
I
OZH
3-状态 输出 高 电流 V
CC
= 3.6v; v
O
= 3.0v; v
I
= v
IH
或者 v
IL
0.5 5
µ
一个
I
OZL
3-状态 输出 低 电流 V
CC
= 3.6v; v
O
= 0.5v; v
I
= v
IH
或者 v
IL
0.5 –5
µ
一个
I
CCH
V
CC
= 3.6v; 输出 高, v
I
= 地 或者 v
cc,
I
O
=
0 0.07 0.12
I
CCL
安静的 供应 电流 V
CC
= 3.6v; 输出 低, v
I
= 地 或者 v
cc,
I
O
=
0 4.0 6 毫安
I
CCZ
V
CC
= 3.6v; 输出 无能; v
I
= 地 或者 v
cc,
I
O
=
0
6
0.07 0.12
∆
I
CC
额外的 供应 电流 每
输入 管脚
2
V
CC
= 3v 至 3.6v; 一个 输入 在 v
CC
-0.6v,
其它 输入 在 v
CC
或者 地
0.1 0.2 毫安
注释:
1. 所有 典型 值 是 在 v
CC
= 3.3v 和 t
amb
= 25
°
c.
2. 这个 是 这 增加 在 供应 电流 为 各自 输入 在 这 指定 电压 水平的 其它 比 v
CC
或者 地.
3. 这个 参数 是 有效的 为 任何 v
CC
在 0v 和 1.2v 和 一个 转变 时间 的 向上 至 10msec. 从 v
CC
= 1.2v 至 v
CC
= 3.3v
±
0.3v 一个
转变 时间 的 100
µ
秒 是 permitted. 这个 参数 是 有效的 为 t
amb
= 25
°
c 仅有的.
4. unused 管脚 在 v
CC
或者 地.
5. 为 有效的 测试 结果, 数据 必须 不 是 承载 在 这 flip-flops (或者 latches) 之后 应用 power.
6. I
CCZ
是 量过的 和 输出 牵引的 至 v
CC
或者 地.
7. 这个 是 这 总线 支撑 overdrive 电流 必需的 至 强迫 这 输入 至 这 opposite 逻辑 状态.
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