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资料编号:71734
 
资料名称:SN74LS125ADRE4
 
文件大小: 265.25K
   
说明
 
介绍:
QUADRUPLE BUS BUFFERS WITH 3-STATE OUTPUTS
 
 


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sn54125, sn54126, sn54ls125a, sn54ls126a,
sn74125, sn74126, sn74ls125a, sn74ls126a
quadruple 总线 缓存区 和 3-状态 输出
SDLS044A
12月 1983
修订 march 2002
7
邮递 办公室 盒 655303
达拉斯市, 德州 75265
参数 度量 信息
序列 54/74 设备
t
PHL
t
PLH
t
PLH
t
PHL
加载 电路
为 3-状态 输出
高-水平的
脉冲波
低-水平的
脉冲波
电压 波形
脉冲波 durations
输入
输出-的-阶段
输出
(看 便条 d)
3 v
0 v
V
OL
V
OH
V
OH
V
OL
在-阶段
输出
(看 便条 d)
电压 波形
传播 延迟 时间
V
CC
R
L
测试
要点
从 输出
下面 测试
C
L
(看 便条 一个)
加载 电路
为 打开-集电级 输出
加载 电路
为 2-状态 totem-柱子 输出
(看 便条 b)
V
CC
R
L
从 输出
下面 测试
C
L
(看 便条 一个)
测试
要点
(看 便条 b)
V
CC
R
L
从 输出
下面 测试
C
L
(看 便条 一个)
测试
要点
1 k
注释: 一个. C
L
包含 探查 和 jig 电容.
b. 所有 二极管 是 1n3064 或者 相等的.
c. 波形 1 是 为 一个 输出 和 内部的 情况 此类 那 这 输出 是 低 除了 当 无能 用 这 输出 控制.
波形 2 是 为 一个 输出 和 内部的 情况 此类 那 这 输出 是 高 除了 当 无能 用 这 输出 控制.
d. s1 和 s2 是 关闭 为 t
PLH
, t
PHL
, t
PHZ
, 和 t
PLZ
; s1 是 打开 和 s2 是 关闭 为 t
PZH
; s1 是 关闭 和 s2 是 打开 为 t
PZL
.
e. 所有 输入 脉冲 是 有提供的 用 发生器 having 这 下列的 特性: prr
1 mhz, z
O
50
; t
r
和 t
f
7 ns 为 序列
54/74 设备 和 t
r
和 t
f
2.5 ns 为 序列 54s/74s 设备.
f. 这 输出 是 量过的 一个 在 一个 时间 和 一个 输入 转变 每 度量.
S1
S2
t
PHZ
t
PLZ
t
PZL
t
PZH
3 v
3 v
0 v
0 v
t
h
t
su
电压 波形
建制 和 支撑 时间
定时
输入
数据
输入
3 v
0 v
输出
控制
(低-水平的
enabling)
波形 1
(看 注释 c
和 d)
波形 2
(看 注释 c
和 d)
1.5 v
V
OH
0.5 v
V
OL
+ 0.5 v
1.5 v
电压 波形
使能 和 使不能运转 时间, 3-状态 输出
1.5 v 1.5 v
1.5 v 1.5 v
1.5 v
1.5 v 1.5 v
1.5 v 1.5 v
1.5 v
1.5 v
t
w
1.5 v 1.5 v
1.5 v 1.5 v
1.5 v 1.5 v
V
OH
V
OL
图示 1. 加载 电路 和 电压 波形
这 sn54125, sn54126, sn74125,
sn74126, 和 sn54ls126a 是
废弃的 和 是 非 变长 有提供的
.
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