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资料编号:718617
 
资料名称:MAX1137EUA
 
文件大小: 471.99K
   
说明
 
介绍:
2.7V to 3.6V and 4.5V to 5.5V, Low-Power, 4-/12-Channel, 2-Wire Serial 10-Bit ADCs
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
便条 1:
为 直流 精度, 这 max1136/max1138 是 测试 在 v
DD
= 5v 和 这 max1137/max1139 是 测试 在 v
DD
= 3v. 所有
设备 是 配置 为 单极的, 单独的-结束 输入.
便条 2:
相关的 精度 是 这 背离 的 这 相似物 值 在 任何 代号 从 它的 theoretical 值 之后 这 全部-规模 范围 和
补偿 有 被 校准.
便条 3:
补偿 nulled.
便条 4:
转换 时间 是 定义 作 这 号码 的 时钟 循环 需要 为 转换 multiplied 用 这 时钟 时期. 转换
时间 做 不 包含 acquisition 时间. scl 是 这 转换 时钟 在 这 外部 时钟 模式.
便条 5:
一个 过滤 在 这 sda 和 scl 输入 抑制 噪音 尖刺 和 延迟 这 抽样 instant.
便条 6:
这 绝对 输入-电压 范围 为 这 相似物 输入 (ain0
ain11) 是 从 地 至 v
DD
.
便条 7:
当 这 内部的 涉及 是 配置 至 是 有 在 ain_/ref (sel[2:1] = 11) 分离 ain_/ref 至 地 和 一个
0.01µf 电容.
便条 8:
模数转换器 效能 是 限制 用 这 转换器
s 噪音 floor, 典型地 300µv
p-p
.
便条 9:
量过的 作 为 这 max1137/max1139
和 为 这 max1136/max1138
便条 10:
一个 主控 设备 必须 提供 一个 数据 支撑 时间 为 sda (涉及 至 v
IL
的 scl) 在 顺序 至 桥 这 未阐明的 区域 的
SCL
s 下落 边缘 (看 图示 1).
便条 11:
C
B
= 总的 电容 的 一个 总线 线条 在 pf.
便条 12:
f
SCL
必须 满足 这 最小 时钟 低 时间 加 这 上升/下降 时间.
VVVV
V
VV
FS FS
REF
N
(. ) (. )
(. . )
55 45
21
55 45
[]
×
VVVV
V
VV
FS FS
REF
N
(. ) (. )
(. . )
36 27
21
36 27
[]
×
MAX1136–MAX1139
2.7v 至 3.6v 和 4.5v 至 5.5v, low-power,
4-/12-频道, 2-线 串行 10-位 adcs
_______________________________________________________________________________________ 5
定时 特性 (图示 1) (持续)
(v
DD
= 2.7v 至 3.6v (max1137/max1139), v
DD
= 4.5v 至 5.5v (max1136/max1138), v
REF
= 2.048v (max1137/max1139), v
REF
=
4.096v (max1136/max1138), c
REF
= 0.1µf, f
SCL
= 1.7mhz, t
一个
= t
最小值
至 t
最大值
, 除非 否则 指出. 典型 值 是 在
T
一个
= +25
°
c. 看 tables 1
5 为 程序编制 notation.)
参数 标识 情况 最小值 典型值 最大值 单位
上升 时间 的 scl 信号
(电流 源 使能)
t
RCL
量过的 从 0.3v
DD
至 0.7v
DD
20 80 ns
上升 时间 的 scl 信号 之后
acknowledge 位
t
RCL1
量过的 从 0.3v
DD
至 0.7v
DD
20 160 ns
下降 时间 的 scl 信号 t
FCL
量过的 从 0.3v
DD
至 0.7v
DD
20 80 ns
上升 时间 的 sda 信号 t
RDA
量过的 从 0.3v
DD
至 0.7v
DD
20 160 ns
下降 时间 的 sda 信号 t
FDA
量过的 从 0.3v
DD
至 0.7v
DD
20 160 ns
建制 时间 为 停止 (p) 情况 t
SU
,
STO
160 ns
电容的 加载 为 各自 总线 线条 C
B
400 pF
脉冲波 宽度 的 尖刺 suppressed t
SP
(注释 10 和 12) 0 10 ns
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