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资料编号:725942
资料名称:
CXA3506R
文件大小: 2122.97K
说明
:
介绍
:
3-channel 8-bit 120MSPS A/D Converter Amplifier PLL
: 点此下载
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3
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9
10
本平台电子爱好着纯手工中文简译:
截至2020/5/17日,支持英文词汇500个
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6
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CXA3506R
PECLIN
RC2
PLL
1bit
pd pol
RC1
重置 脉冲波
发生器
TTLIN
SW
M
极性
TTLOUT
TTLOUT
TTLOUT
DSYNC
支撑
SW
SW
M
m/s
1/2
SW
DIV
1, 2, 4, 8
vco + 1/4
Fine
延迟
承担
打气
阶段
探测器
可编程序的
计数器
TTLOUT
TTLIN
TTLIN
TTLIN
极性
支撑 pol
1bit
1bit
sog 使能
1bit
sog 输出 polsync 输出 sw
1bit
rgbin1/2sel
1bit
1bit
IREF
Clamp
脉冲波
XTLOAD
(ttl)
syncp/hsync
1bit
同步 pol
3bit
12bit
vco div
hsync1/2
1bit
clp pol
1bit
TTLIN
DAC
极性
TTLIN
PLL
电源 保存
极性
极性
SW
SW
SW
SW
6bit
1/256 至 1/4096
2bit
1bit
dsync 用-通过
1bit
VCO
用-通过
2bit
重置
1bit
1bit
DSYNC
支撑
clk 使能
DIV
1, 2, 4, 8
1bit
1bit
1bit
xclk 使能
1bit
1/2clk 使能
1bit
1/2xclk 使能
unlock 使能
TTLOUT
TTLOUT
1bit
1bit
dsync 使能
甚至/odd
(ttl)
dsync/divout
(ttl)
CLKIN
(pecl)
XCLKIN
(pecl)
SOGOUT
(ttl)
SYNCIN1
(ttl)
SYNCIN2
(ttl)
支撑
(ttl)
CLPIN
(ttl)
同步 在 绿色
SYNCT1
同步 在 绿色
SYNCT2
同步 在 绿色
SYNCP
CLK
(ttl)
XCLK
(ttl)
1/2clk
(ttl)
1/2xclk
(ttl)
UNLOCK
1/2clk (模数转换器)
clk (模数转换器)
dsync pol
UNLOCK
发现
J
K
Q
Q
m/s
SW
coarse 延迟
Coarse
延迟
DIVOUT
脉冲波 宽度
2bit
divout 宽度
1bit
divout 延迟
DIVOUT
延迟
pll 块 图解
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