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资料编号:751659
 
资料名称:CD74HC4046AE
 
文件大小: 316K
   
说明
 
介绍:
High-Speed CMOS Logic Phase-Locked Loop with VCO
 
 


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4
频率 俘获 范围 (2f
C
) defined
频率 范围 输入 信号 这个 PLL 如果
initially 输出-的-锁. 频率 范围 (2f
L
)是
defined 频率 范围 输入 信号 这个
循环 停留 如果 initially 锁. 俘获
范围 是 小 或者 equal 至 这 锁 范围.
pc1, 俘获 范围 取决于 低-通过 filter
特性 制造 范围.
这个 configuration retains 行为 甚至 非常 嘈杂的
输入 信号. 典型 这个 类型 阶段 比较器
输入 发生率 关闭 和声学
vco 中心 频率.
阶段 比较器 2 (pc2)
这个 一个 积极的 边缘-triggered 阶段 频率
探测器. PLL 使用 这个 比较器, 循环
控制 积极的 信号 transitions 职责
factors SIG
竞赛
重要的. PC2
comprises d-类型 flip-flops, 控制-gating 一个 三-
状态 输出 平台. 电路 功能 一个 向上-向下
计数器 (图示 1) 在哪里 SIG
导致 一个 向上-计数
竞赛
一个 向下-计数. 转移 函数 pc2,
假设 波纹 (f
r
= f
i
) 是 suppressed, 是:
V
DEMOUT
=(v
CC
/4
π
)(
φ
SIG
-
φ
竞赛
) 在哪里
V
DEMOUT
demodulator 输出 管脚 10;
V
DEMOUT
=V
PC2OUT
(通过 低-通过 filter).
平均 输出 电压 pc2, 喂养 VCO 通过
低-通过 filter seen demodulator 输出 管脚 10
(v
DEMOUT
), resultant 阶段 differences
SIG
竞赛
显示 图示 4. 典型 波形
为 这 pc2 循环 锁 在 f
o
是 显示 在 图示 5.
发生率 SIG
竞赛
equal 但是
阶段 SIG
leads 竞赛
, p-类型 输出
驱动器 PC2
输出
使保持 “ON” 一个 时间 相应的
阶段 区别 (
φ
DEMOUT
). 阶段 SIG
lags 那 的 竞赛
, 这 n-类型 驱动器 是 使保持 “on”.
频率 SIG
高等级的
竞赛
, p-类型 输出 驱动器 使保持 “ON” 大多数
输入 信号 循环 时间, remainder
循环 两个都 n- p-类型 驱动器 “OFF” (三-状态). 如果
SIG
频率 更小的 竞赛
频率,
然后 n-类型 驱动器 使保持 “ON” 大多数
循环. subsequently, 电压 电容 (c2)
低-通过 filter 连接 PC2
输出
varies 直到
信号 比较器 输入 equal 两个都 阶段
图示 2. 阶段 比较器 1: 平均 输出
电压 vs 输入 阶段 区别:
V
DEMOUT
= v
PC1OUT
= (v
CC
/
π
) (
φ
SIG
-
φ
竞赛
);
φ
DEMOUT
=(
φ
SIG
-
φ
竞赛
)
V
CC
V
demout (av)
1/2 v
CC
0
0
o
90
o
φ
DEMOUT
180
o
图示 3. 典型 波形 PLL 使用 阶段
比较器 1, 循环 锁 在 f
o
SIG
竞赛
VCO
输出
PC1
输出
VCO
V
CC
图示 4. 阶段 比较器 2: 平均 输出
电压 vs 输入 阶段 区别:
V
DEMOUT
= v
PC2OUT
= (v
CC
/4
π
) (
φ
SIG
-
φ
竞赛
);
φ
DEMOUT
=(
φ
SIG
-
φ
竞赛
)
V
CC
V
demout (av)
1/2 v
CC
0
-360
o
0
o
φ
DEMOUT
360
o
图示 5. 典型 波形 为 pll 使用 阶段
比较器 2, 循环 锁 在 f
o
SIG
竞赛
VCO
输出
PC2
输出
VCO
V
CC
PCP
输出
高 阻抗 止 - 状态
cd54hc4046a, cd74hc4046a, cd54hct4046a, cd74hct4046acd54hc4046a, cd74hc4046a, cd54hct4046a, cd74hct4046a
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