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资料编号:803124
 
资料名称:AD421BRRL
 
文件大小: 171K
   
说明
 
介绍:
Loop-Powered 4 mA to 20 mA DAC
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
AD421
–3–
rev. c
定时 特性
1, 2, 3
参数 (b 版本) 单位 情况/comments
t
CK
100 ns 最小值 数据 时钟 时期
t
CL
50 ns 最小值 数据 时钟 低 时间
t
CH
50 ns 最小值 数据 时钟 高 时间
t
DW
30 ns 最小值 数据 稳固的 宽度
t
DS
30 ns 最小值 数据 建制 时间
t
DH
0 ns 最小值 数据 支撑 时间
t
LD
50 ns 最小值 获得 延迟 时间
t
LL
50 ns 最小值 获得 低 时间
t
LH
50 ns 最小值 获得 高 时间
注释
1
有保证的 用 描绘 在 最初的 产品 释放, 不 生产 测试.
2
看 计算数量 1 和 2.
3
所有 输入 信号 是 指定 和 tr = tf = 5 ns (10% 至 90% 的 v
CC
) 和 安排时间 从 一个 电压 水平的 的 (v
+ v
IL
)/2; tr 和 tf 应当 不 超过 1
µ
s 在 任何 数字的
输入.
规格 主题 至 改变 没有 注意.
文字 "n" 文字 "n +1"
10 11 11111
1
00 00 00 1 00 1
时钟
数据
获得
B15
(msb)
B14
B13
B12
B11
B10
B9
B8
B7
B6
B5
B4
B3
B2
B1
B0
B15
B14
B13
B12
(lsb)
图示 1. 串行 接口 波形 (正常的 数据 加载)
时钟
数据
获得
t
CK
t
CL
t
CH
t
DS
t
DH
t
DW
t
LD
t
LL
t
LH
图示 2. 串行 接口 定时 图解
(v
CC
= +3 v 至 +5 v, t
一个
= t
最小值
至 t
最大值
除非 否则 指出)
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