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资料编号:815829
 
资料名称:CY2308SC-2
 
文件大小: 203K
   
说明
 
介绍:
3.3V Zero Delay Buffer
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
CY2308
文件 #: 38-07146 rev. *c 第页 2 的 14
备注:
1. 弱 拉-向下.
2. 弱 下拉 开启 全部 产出.
3. 弱 引体向上 开启 这些 输入.
4. 产出 倒置 开启 2308–2 和 2308–3 入点 旁路 模式, s2 = 1 和 s1 = 0.
5. 输出 相位 是 不确定因素 (0° 或 180° 从 输入时钟). 如果 相位 完整性 是 必填项, 使用 这 cy2308–2.
管脚 描述
管脚 信号 描述
1REF
[1]
输入 参考 频率, 5v 宽容 输入
2 CLKA1
[2]
时钟 输出, 银行 一个
3 CLKA2
[2]
时钟 输出, 银行 一个
4V
dd
3.3v 供应
5 接地
6 CLKB1
[2]
时钟 输出, 银行 b
7 CLKB2
[2]
时钟 输出, 银行 b
8S2
[3]
选择 输入, 有点 2
9S1
[3]
选择 输入, 有点 1
10 CLKB3
[2]
时钟 输出, 银行 b
11 CLKB4
[2]
时钟 输出, 银行 b
12 接地
13 v
dd
3.3v 供应
14 CLKA3
[2]
时钟 输出, 银行 一个
15 CLKA4
[2]
时钟 输出, 银行 一个
16 FBK pll 反馈 输入
选择 输入 解码
S2 S1 时钟 a1–a4 时钟 b1–b4 输出 来源 pll 停机
0 0 三态 三态 PLL y
0 1 驱动 三态 PLL n
10 驱动
[4]
驱动
[4]
参考 y
1 1 驱动 驱动 PLL n
可用 cy2308 配置
设备 反馈 从 银行 一个 频率 银行 b 频率
CY2308–1 银行 一个 或 银行 b 参考 参考
CY2308–1H 银行 一个 或 银行 b 参考 参考
CY2308–2 银行 一个 参考 参考/2
CY2308–2 银行 b 2 x 参考 参考
CY2308–3 银行 一个 2 x 参考 参考 或 参考
[5]
CY2308–3 银行 b 4 x 参考 2 x 参考
CY2308–4 银行 一个 或 银行 b 2 x 参考 2 x 参考
CY2308–5H 银行 一个 或 银行 b 参考 /2 参考 /2
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