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资料编号:8832
 
资料名称:MAX520ACWE
 
文件大小: 274.75K
   
说明
 
介绍:
Quad/Octal, 2-Wire Serial 8-Bit DACs with Rail-to-Rail Outputs
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
max520/max521
四方形/octal, 2-线 串行 8-位 dacs
和 栏杆-至-栏杆 输出
_______________________________________________________________________________________ 5
便条 8:
一个 主控 设备 必须 提供 一个 支撑 时间 的 在 least 300ns 为 这 sda 信号 (涉及 至 v
IL
的 这 scl 信号) 在 顺序 至
桥 这 未阐明的 区域 的 scl’s 下落 边缘.
便条 9:
cb = 总的 电容 的 一个 总线 线条 在 pf. t
R
和 t
f
量过的 在 0.3v
DD
和 0.7v
DD
.
便条 10:
一个 输入 过滤 在 这 sda 和 scl 输入 抑制 噪音 尖刺 较少 比 50ns.
便条 11:
有保证的 用 设计.
支撑 时间, (重复的) 开始 情况 t
hd, sta
0.6 µs
低 时期 的 这 scl 时钟 t
1.3 µs
高 时期 的 这 scl 时钟 t
0.6
参数 标识 最小值 典型值 最大值 单位
串行 时钟 频率 f
SCL
0 400 kHz
总线 自由 时间 在 一个 停止 和 一个
开始 情况
t
BUF
1.3 µs
情况
µs
建制 时间 为 一个 重复的 开始 情况 t
su, sta
0.6 µs
数据 支撑 时间 t
hd, dat
0 0.9 µs
数据 建制 时间 t
su, dat
100
(便条 8)
ns
下降 时间 的 sda transmitting (便条 6) t
F
20 + 0.1cb 250 ns
建制 时间 为 停止 情况 t
su, sto
0.6 µs
电容的 加载 为 各自 总线 线条 Cb 400
I
下沉
6ma (便条 9)
pF
上升 时间 的 两个都 sda 和 scl 信号, 接到 t
R
20 + 0.1cb 300 ns
下降 时间 的 两个都 sda 和 scl 信号, 接到 t
F
20 + 0.1cb 300
(便条 9)
(便条 9) ns
脉冲波 宽度 的 尖刺 suppressed t
SP
050(注释 10, 11) ns
定时 特性
(v
DD
= 5v ±10%, t
一个
= t
最小值
至 t
最大值
, 除非 否则 指出. 典型 值 是 在 t
一个
= +25°c.)
__________________________________________典型 运行 特性
(v
DD
= 5v, dac 输出 unloaded, t
一个
= +25°c, 除非 否则 指出.)
10
9
0
-60 -30 30 90 120 150
MAX520
供应 电流 vs. 温度
2
1
8
7
max520/521-01
温度 (°c)
I
DD
(
µ
一个)
060
6
5
4
3
运行 模式 or
关闭 模式
40
0
-60 -30 30 90 120 150
MAX520
涉及 输入 电流 vs.
温度 (关闭 模式)
5
35
30
max520/521-02
温度 (°c)
关闭 涉及 电流 (na)
060
25
20
15
10
V
REF
= 4v
一个 ref 输入 驱动
0
1k 100k10k 1M 10M
MAX520
涉及 电压 input
频率 回馈
-16
-18
max520/521-03
频率 (hz)
相关的 输出 (db)
-14
-12
-10
-8
-6
-4
-2
2
V
DD
= 5v
V
REF
= 4vp-p sine wave
集中 在 2.5v
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