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资料编号:914229
 
资料名称:CS82C54-10
 
文件大小: 142K
   
说明
 
介绍:
CMOS Programmable Interval Timer
 
 


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4-4
控制 文字 寄存器
这 控制 文字 寄存器 (图示 2) 是 选择 用 这
读/写 逻辑 当 a1, a0 = 11. 如果 这 cpu 然后 做 一个
写 运作 至 这 82c54, 这 数据 是 贮存 在 这 con-
trol 文字 寄存器 和 是 interpreted 作 一个 控制 文字 使用
至 define 这 计数器 运作.
这 控制 文字 寄存器 能 仅有的 是 写 至; 状态
信息 是 有 和 这 读-后面的 command.
计数器 0, 计数器 1, 计数器 2
这些 三 函数的 blocks 是 完全同样的 在 运作, 所以
仅有的 一个 单独的 计数器 将 是 描述. 这 内部的 块
图解 的 一个 信号 计数器 是 显示 在 图示 3. 这
counters 是 全部地 独立. 各自 计数器 将 运作
在 一个 不同的 模式.
这 控制 文字 寄存器 是 显示 在 这 figure; 它 是 不
部分 的 这 计数器 它自己, 但是 它的 内容 决定 如何 这
计数器 运作.
这 状态 寄存器, 显示 在 这 figure, 当 latched, con-
tains 这 电流 内容 的 这 控制 文字 寄存器 和
状态 的 这 输出 和 无效的 计数 flag. (看 详细地 expla-
nation 的 这 读-后面的 command.)
这 真实的 计数器 是 labeled ce (为 counting 元素). 它 是
一个 16-位 presettable 同步的 向下 计数器.
olm 和 oll 是 二 8-位 latches. ol stands 为 “output
latch”; 这 subscripts m 和 l 为 “most significant byte” 和
“least significant byte”, 各自. 两个都 是 正常情况下 涉及
至 作 一个 单位 和 called just ol. 这些 latches 正常情况下 “fol-
low” 这 ce, 但是 如果 一个 合适的 计数器 获得 command 是 sent 至
这 82c54, 这 latches “latch” 这 呈现 计数 直到 读 用
这 cpu 和 然后 返回 至 “following” 这 ce. 一个 获得 在 一个
时间 是 使能 用 这 计数器’s 控制 逻辑 至 驱动 这 inter-
nal 总线. 这个 是 如何 这 16-位 计数器 communicates 在 这
8-位 内部的 总线. 便条 那 这 ce 它自己 不能 是 读; 当-
总是 你 读 这 计数, 它 是 这 ol 那 是 正在 读.
similarly, 那里 是 二 8-位 寄存器 called crm 和 crl (为
“count register”). 两个都 是 正常情况下 涉及 至 作 一个 单位 和
called just cr. 当 一个 新 计数 是 写 至 这 计数器, 这
计数 是 贮存 在 这 cr 和 后来的 transferred 至 这 ce. 这
控制 逻辑 准许 一个 寄存器 在 一个 时间 至 是 承载 从
这 内部的 总线. 两个都 字节 是 transferred 至 这 ce simulta-
neously. crm 和 crl 是 cleared 当 这 计数器 是 pro-
grammed 为 一个 字节 counts (也 大多数 significant 字节 仅有的
或者 least significant 字节 仅有的) 这 其它 字节 将 是 零. 便条
那 这 ce 不能 是 写 在; whenever 一个 计数 是 写,
它 是 写 在 这 cr.
这 控制 逻辑 是 也 显示 在 这 图解. clk n,
门 n, 和 输出 n 是 所有 连接 至 这 外部 world
通过 这 控制 逻辑.
82c54 系统 接口
这 82c54 是 treated 用 这 系统 软件 作 一个 排列 的
附带的 i/o 端口; 三 是 counters 和 这 fourth 是 一个
控制 寄存器 为 模式 程序编制.
basically, 这 选择 输入 a0, a1 连接 至 这 a0, a1
地址 总线 信号 的 这 cpu. 这
cs 能 是 获得
直接地 从 这 地址 总线 使用 一个 直线的 选择 方法 或者
它 能 是 连接 至 这 输出 的 一个 解码器.
读/
逻辑
数据/
总线
缓存区
内部的 总线
输出 2
门 2
clk 2
输出 1
门 1
clk 1
输出 0
门 0
clk 0
WR
RD
D
7
- d
0
一个
0
一个
1
CS
图示 2. 控制 文字 寄存器 和 计数器
功能
8
控制
文字
寄存器
计数器
2
计数器
1
计数器
0
内部的 总线
控制
逻辑
控制
文字
寄存器
状态
获得
状态
寄存器
clk n
门 n
输出 n
OL
M
OL
L
CE
CR
M
CR
L
图示 3. 计数器 内部的 块 图解
82C54
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