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初步的 信息 rev. 00C
01/20/05
is42s81600a, is42s16800a, is42s32400a
设备 overview
这 128mb sdram 是 一个 高 速 cmos, 动态
随机的-进入 记忆 设计 至 运作 在 3.3v v
DD
和 3.3v v
DDQ
记忆 系统 containing 134,217,728
位. 内部 配置 作 一个 四方形-bank dram 和 一个
同步的 接口. 各自 33,554,432-位 bank 是 orga-
nized 作 4,096 rows 用 512 columns 用 16 位.
这 128mb sdram 包含 一个 自动 refresh 模式,
和 一个 电源-节省, 电源-向下 模式. 所有 信号 是
注册 在 这 积极的 边缘 的 这 时钟 信号, clk. 所有
输入 和 输出 是 lvttl 兼容.
这 128mb sdram 有 这 能力 至 synchronously burst
数据 在 一个 高 数据 比率 和 自动 column-地址
一代, 这 能力 至 interleave 在 内部的 banks
至 hide precharge 时间 和 这 能力 至 randomly
改变 column 地址 在 各自 时钟 循环 在
burst 进入.
一个 自-安排时间 行 precharge initiated 在 这 终止 的 这 burst
sequence 是 有 和 这 自动 precharge func-
tion 使能.
Precharge
一个 bank 当 accessing 一个 的 这
其它 三 banks 将 hide 这
precharge
循环 和提供
seamless, 高-速, 随机的-进入 运作.
SDRAM
读 和 写 accesses 是 burst 朝向 开始 在
一个 选择 location 和 continuing 为 一个 编写程序 num-
ber 的 locations 在 一个 编写程序 sequence. 这 registra-
tion 的 一个 起作用的 command begins accesses, followed 用
一个 读 或者 写 command. 这 起作用的 command 在
conjunction 和 地址 位 注册 是 使用 至 选择
这 bank 和 行 至 是 accessed (ba0, ba1 选择 这
bank; a0-a11 选择 这 行). 这 读 或者 写
commands 在 conjunction 和 地址 位 注册 是
使用 至 选择 这 开始 column location 为 这 burst
进入.
可编程序的 读 或者 写 burst 长度 组成 的 1,
2, 4 和 8 locations 或者 全部 页, 和 一个 burst terminate
选项.
CLK
CKE
CS
RAS
CAS
我们
A9
A8
A7
A6
A5
A4
A3
A2
A1
A0
BA0
BA1
A10
COMMAND
解码器
&放大;
时钟
发生器
模式
寄存器
REFRESH
控制
REFRESH
计数器
自
REFRESH
控制
行
地址
获得
多路调制器
COLUMN
地址 获得
burst 计数器
COLUMN
地址 缓存区
column 解码器
数据 在
缓存区
数据 输出
缓存区
DQML
DQMH
i/o 0-15
V
DD
/v
DDQ
V
ss
/v
ss
Q
12
12
9
12
12
9
16
16 16
16
512
(x 16)
4096
4096
4096
行 解码器
4096
记忆 cell
排列
bank 0
sense 放大 i/o 门
bank 控制 逻辑
行
地址
缓存区
A11
2
函数的 块 图解 (为 2mx16x4 banks 仅有的)
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