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资料编号:924009
 
资料名称:IS62C1024-45QI
 
文件大小: 423K
   
说明
 
介绍:
128K x 8 HIGH-SPEED CMOS STATIC RAM
 
 


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6
整体的 电路 解决方案 公司
sr016-0b
IS62C1024
写 循环 切换 特性
(1,3)
(在 运行 范围, 标准 和 低
电源)
-35 -45 -55 -70
标识 参数 最小值 最大值 最小值 最大值 最小值 最大值 最小值 最大值 单位
t
WC
写 循环 时间 35 45 55 70 ns
t
SCE
1
CE1
至 写 终止 25 35 50 60 ns
t
SCE
2
ce2 至 写 终止 25 35 50 60 ns
t
AW
地址 建制 时间 至 写 终止 25 35 45 60 ns
t
HA
地址 支撑 从 写 终止 0 0 0 0 ns
t
SA
地址 建制 时间 0 0 0 0 ns
t
PWE
(4)
我们
脉冲波 宽度 25 35 40 50 ns
t
SD
数据 建制 至 写 终止 20 25 25 30 ns
t
HD
数据 支撑 从 写 终止 0 0 0 0 ns
t
HZWE
(2)
我们
低 至 高-z 输出 10 15 20 25 ns
t
LZWE
(2)
我们
高 至 低-z 输出 3 5 5 5 ns
注释:
1. 测试 情况 假设 信号 转变 时间 的 5 ns 或者 较少, 定时 涉及 水平 的 1.5v, 输入 脉冲波 水平 的 0 至 3.0v
和 输出 加载 指定 在 图示 1a.
2. 测试 和 这 加载 在 图示 1b. 转变 是 量过的 ±500 mv 从 稳步的-状态 电压. 不 100% 测试.
3. 这 内部的 写 时间 是 定义 用 这 overlap 的
CE1
低, ce2 高 和
我们
低. 所有 信号 必须 是 在 有效的 states 至
initiate 一个 写, 但是 任何 一个 能 go inactive 至 terminate 这 写. 这 数据 输入 建制 和 支撑 定时 是 关联 至 the
rising 或者 下落 边缘 的 这 信号 那 terminates 这 写.
4. 测试 和
OE
高.
数据 未阐明的
t
WC
有效的 地址
t
SCE
t
PWE1
t
PWE2
t
AW
t
HA
高-z
t
HD
t
SA
t
HZWE
地址
CE
我们
D
输出
D
数据
有效的
t
LZWE
t
SD
交流 波形
写 循环 非. 1 (
WEWE
WEWE
我们
控制)
(1,2)
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