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资料编号:954140
 
资料名称:AD5531BRU
 
文件大小: 407K
   
说明
 
介绍:
Serial Input, Voltage Output 12-/14-Bit DACs
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
rev. 0
ad5530/ad5531
–5–
SCLK
同步
SDIN
t
1
DB15 DB14 DB11
MSB
t
4
t
6
t
7
t
8
t
5
t
3
t
2
SDO
(daisy
chaining)
RBEN
SDO
(readback)
DB15
MSB LSB
t
14
t
15
t
16
t
17
RB13 RB0
MSB LSB
0
t
13
t
14
DB0
LSB
DB11 DB0
t
13
0
图示 2. 定时 图解 为 daisy-chaining 和 readback 模式
daisy-chaining 和 readback 定时 特性
1, 2, 3
参数 限制 在 t
最小值
, t
最大值
单位 描述
f
最大值
2 mhz 最大值 sclk 频率
t
1
500 ns 最小值 sclk 循环 时间
t
2
200 ns 最小值 sclk 低 时间
t
3
200 ns 最小值 sclk 高 时间
t
4
50 ns 最小值
同步
至 sclk 下落 边缘 建制 时间
t
5
40 ns 最小值 sclk 下落 边缘 至
同步
rising 边缘
t
6
50 ns 最小值 最小值
同步
高 时间
t
7
40 ns 最小值 数据 建制 时间
t
8
15 ns 最小值 数据 支撑 时间
t
12
50 ns 最小值
CLR
Pulsewidth
t
13
130 ns 最小值 sclk 下落 边缘 至 sdo 有效的
t
14
50 ns 最大值 sclk 下落 边缘 至 sdo invalid
t
15
50 ns 最小值
RBEN
至 sclk 下落 边缘 建制 时间
t
16
50 ns 最小值
RBEN
支撑 时间
t
17
100 ns 最小值
RBEN
下落 边缘 至 sdo 有效的
1
有保证的 用 设计. 不 生产 测试.
2
样本 测试 在 最初的 释放 和 之后 任何 redesign 或者 处理 改变 那 将 影响 这个 参数. 所有 输入 信号 是 量过的 和 tr = tf = 5 ns
(10% 至 90% 的 v
DD
) 和 安排时间 从 一个 电压 水平的 的 (v
IL
+V
IH
)/2.
3
sdo; r
PULLUP
= 5 k
, c
L
= 15 pf.
规格 主题 至 改变 没有 注意.
(v
DD
= 10.8 v 至 16.5 v, v
SS
=
10.8 V
16.5 v; v
SS
=
15 v
±
10%; 地 = 0 v; r
L
= 5 k
和 c
L
= 220 pf 至 地. 所有 规格 t
最小值
至 t
最大值
, 除非 否则 指出.)
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