管脚 描述 和 相等的 电路
(持续)
管脚 非. 标识 相等的 电路 描述
23 PD
电源 向下 输入. 当 这个 管脚 是 高, 这 转换器 是
在 这 电源 向下 模式 和 这 数据 输出 管脚 支撑
这 last 转换 结果.
24 CLK
cmos/ttl 兼容 数字的 时钟 输入. V
在
是 抽样
在 这 rising 边缘 的 CLK 输入.
13 thru 16
和
19 thru 22
D0–D7
转换 数据 数字的 输出 管脚. D0 是 这 lsb, D7 是
这 msb. 有效的 数据 是 输出 之后 这 rising 边缘 的 这
CLK 输入.
7V
在
地 涉及 地面 为 这 单独的-结束 相似物 输入, V
在
.
1, 4, 12 V
一个
积极的 相似物 供应 管脚. 连接 至 一个 安静 电压
源 的 +3v. V
一个
应当 是 绕过 和 一个 0.1 µF
陶瓷的 碎片 电容 为 各自 管脚, 加 一个
10 µF 电容. 看 部分 3.0 为 更多 信息.
18 V
DR
电源 供应 为 这 输出 驱动器. 如果 连接 至 V
一个
,
分离 好 从 V
一个
.
17 DR 地 这 地面 返回 为 这 输出 驱动器 供应.
2, 5, 8, 11 AGND 这 地面 返回 为 这 相似物 供应.
ADC08L060
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