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ADMC401
–9–
rev. b
参数 最小值 最大值 单位
记忆 写
切换 特性
:
t
DW
数据 建制 在之前
WR
高 0.5t
CK
– 7 + w ns
t
DH
数据 支撑 之后
WR
高 0.25t
CK
– 2 ns
t
WP
WR
Pulsewidth 0.5t
CK
– 5 + w ns
t
WDE
WR
低 至 数据 使能 0 ns
t
ASW
a0–a13,
DMS
,
PMS
建制 在之前
WR
低 0.25t
CK
– 6 ns
t
DDR
数据 使不能运转 在之前
WR
或者
RD
低 0.25t
CK
– 6 ns
t
CWR
clkout 高 至
WR
低 0.25t
CK
– 5 0.25t
CK
+ 7 ns
t
AW
a0–a13,
DMS
,
PMS
, 建制 在之前
WR
Deasserted 0.75t
CK
– 9 + w ns
t
WRA
a0–a13,
DMS
,
PMS
支撑 之后
WR
Deasserted 0.25t
CK
– 3 ns
t
WWR
WR
高 至
RD
或者
WR
低 0.5t
CK
– 5 ns
w = wait states
×
t
CK
.
CLKOUT
A0
–
A13
D
WR
DMS
,
PMS
RD
t
WRA
t
WWR
t
WP
t
ASW
t
AW
t
DH
t
DDR
t
CWR
t
WDE
t
DW
图示 5. 记忆 写

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ADMC401 –9– rev. b 参数最小值最大值单位记忆写切换特性 : t DW 数据建制在之前 WR 高 0.5t CK – 7 + w ns t DH 数据支撑之后 WR 高 0.25t CK – 2 ns t WP WR Pulsewidth 0.5t CK – 5 + w ns t WDE WR 低至数据使能 0 ns t ASW a0–a13, DMS , PMS 建制在之前 WR 低 0.25t CK – 6 ns t DDR 数据使不能运转在之前 WR 或者 RD 低 0.25t CK – 6 ns t CWR clkout 高至 WR 低 0.25t CK – 5 0.25t CK + 7 ns t AW a0–a13, DMS , PMS , 建制在之前 WR Deasserted 0.75t CK – 9 + w ns t WRA a0–a13, DMS , PMS 支撑之后 WR Deasserted 0.25t CK – 3 ns t WWR WR 高至 RD 或者 WR 低 0.5t CK – 5 ns w = wait states × t CK . CLKOUT A0 – A13 D WR DMS , PMS RD t WRA t WWR t WP t ASW t AW t DH t DDR t CWR t WDE t DW 图示 5. 记忆写

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