ADS7822
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SBAS062A
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theory 的 运作
这 ads7822 是 一个 classic successive approximation 寄存器
(sar) 相似物-至-数字的 (一个/d) 转换器. 这 architecture 是
为基础 在 电容的 redistribution 这个 本质上 包含
一个 样本/支撑 函数. 这 转换器 是 fabricated 在 一个 0.6
µ
cmos 处理. 这 architecture 和 处理 准许 这
ads7822 至 acquire 和 转变 一个 相似物 信号 在 向上 至
75,000 conversions 每 第二 当 consuming 非常 little
电源.
这 ads7822 需要 一个 外部 涉及, 一个 外部
时钟, 和 一个 单独的 电源 源 (v
CC
). 这 外部 谈及-
ence 能 是 任何 电压 在 50mv 和 v
CC
. 这 值
的 这 涉及 电压 直接地 sets 这 范围 的 这 相似物
输入. 这 涉及 输入 电流 取决于 在 这 转换
比率 的 这 ads7822.
这 外部 时钟 能 相异 在 10khz (625hz 通过-
放) 和 1.2mhz (75khz throughput). 这 职责 循环 的 这
时钟 是 essentially unimportant 作 长 作 这 最小 高
和 低 时间 是 在 least 400ns (v
CC
= 2.7v 或者 更好).
这 最小 时钟 频率 是 设置 用 这 泄漏 在 这
电容 内部的 至 这 ads7822.
这 相似物 输入 是 提供 至 二 输入 管脚: +in 和 –in.
当 一个 转换 是 initiated, 这 差别的 输入 在 这些
管脚 是 抽样 在 这 内部的 电容 排列. 当 一个
转换 是 在 progress, 两个都 输入 是 disconnected 从
任何 内部的 函数.
这 数字的 结果 的 这 转换 是 clocked 输出 用 这
dclock 输入 和 是 提供 serially, 大多数 重大的 位
第一, 在 这 d
输出
管脚. 这 数字的 数据 那 是 提供 在 这
D
输出
管脚 是 为 这 转换 目前 在 progress—there
是 非 pipeline 延迟. 它 是 可能 至 continue 至 时钟 这
ads7822 之后 这 转换 是 完全 和 至 获得 这
串行 数据 least 重大的 位 第一. 看 这 数字的 定时
部分 为 更多 信息.
相似物 输入
这 +in 和 –in 输入 管脚 准许 为 一个 pseudo-差别的
输入 信号. 不像 一些 转换器 的 这个 类型, 这 –in
输入 是 不 re-抽样 后来的 在 这 转换 循环. 当
这 转换器 变得 在 这 支撑 模式, 这 电压 区别
在 +in 和 –in 是 captured 在 这 内部的 电容
排列.
这 范围 的 这 –in 输入 是 限制 至 –0.2v 至 +1v.
因为 的 这个, 这 差别的 输入 能 是 使用 至 reject
仅有的 小 信号 那 是 一般 至 两个都 输入. 因此, 这
–in 输入 是 最好的 使用 至 sense 一个 偏远的 信号 地面 那
将 move slightly 和 遵守 至 这 local 地面 潜在的.
这 输入 电流 在 这 相似物 输入 取决于 在 一个 号码
的 factors: 样本 比率, 输入 电压, 源 阻抗, 和
电源-向下 模式. essentially, 这 电流 在 这 ads7822
charges 这 内部的 电容 排列 在 这 样本 时期.
之后 这个 电容 有 被 全部地 charged, 那里 是 非
更远 输入 电流. 这 源 的 这 相似物 输入 电压
必须 是 能 至 承担 这 输入 电容 (25pf) 至 一个
12-位 安排好 水平的 在里面 1.5 时钟 循环. 当 这
转换器 变得 在 这 支撑 模式 或者 当 它 是 在 这 电源
向下 模式, 这 输入 阻抗 是 更好 比 1g
Ω
.
小心 必须 是 带去 关于 这 绝对 相似物 输入
电压. 至 维持 这 线性 的 这 转换器, 这 –in
输入 应当 不 漏出 在下 地 – 200mv 或者 超过
地 + 1v. 这 +in 输入 应当 总是 仍然是 在里面 这
范围 的 地 – 200mv 至 v
CC
+ 200mv. 外部 的 这些
范围, 这 转换器’s 线性 将 不 满足 规格.
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