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资料编号:974885
 
资料名称:CD54HCT280F3A
 
文件大小: 261K
   
说明
 
介绍:
High-Speed CMOS Logic 9-Bit Odd/Even Parity Generator/Checker
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
4
输出 转变 时间 t
TLH
, t
THL
C
L
= 50pf 2 - 75 95 110 ns
4.5 - 15 19 22 ns
6 - 13 16 19 ns
输入 电容 C
I
---1010 10pF
电源 消耗
电容
(注释 3, 4)
C
PD
- 5 58 - - - pF
hct 类型
传播 延迟,
任何 输入 至
Σ
O
t
PLH
, t
PHL
C
L
= 50pf 4.5 - 45 56 68 ns
C
L
= 15pf 5 19 - - - ns
传播 延迟,
任何 输入 至
Σ
E
t
PLH
, t
PHL
C
L
= 50pf 4.5 - 42 53 63 ns
C
L
= 15pf 5 18 - - - ns
输出 转变 时间 t
TLH
, t
THL
C
L
= 50pf 4.5 - 15 19 22 ns
输入 电容 C
---1010 10pF
电源 消耗
电容
(注释 3, 4)
C
PD
- 5 58 - - - pF
注释:
3. C
PD
是 使用 至 决定 这 动态 电源 消耗量, 每 包装.
4. P
D
= v
CC
2
f
i
(c
PD
+ c
L
) 在哪里 f
i
= 输入 频率, f
O
= 输出 频率, c
L
= 输出 加载 电容, v
CC
= 供应 电压.
切换 specifications
输入 t
r
, t
f
= 6ns
(持续)
参数 标识
测试
情况 V
CC
(v)
25
o
C -40
o
c 至 85
o
C
-55
o
c 至
125
o
C
UNITSTYP 最大值 最大值 最大值
测试 电路 和 波形
图示 1. HC 转变 时间 传播
延迟 时间, 结合体 逻辑
图示 2. HCT 转变 时间 传播
延迟 时间, 结合体 逻辑
t
PHL
t
PLH
t
THL
t
TLH
90%
50%
10%
50%
10%
反相的
输出
输入
V
CC
t
r
= 6ns t
f
= 6ns
90%
t
PHL
t
PLH
t
THL
t
TLH
2.7v
1.3v
0.3v
1.3v
10%
反相的
输出
输入
3V
t
r
= 6ns
t
f
= 6ns
90%
cd54hc280, cd74hc280, cd54hct280, cd74hct280
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