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交流 测试 输入, 输出 波形
测试 加载 电路
注释:
1. C
L
=100pf 为 clk 输出.
2. C
L
= 50pf 为 所有 输出 除了 clk.
3. C
L
= 包含 探查 和 jig 电容.
图示 5. 测试 加载 度量 情况
图示 6. tchcl, tclch 加载 电路
图示 7. trylcl, tryhch 加载 电路
C
L
输出 从
设备 下面 测试
(看 便条 3)
r = 740
Ω
为 所有 输出
除了 clk
463
Ω
为 clk 输出
2.25v
C1
C2
X1
X2
CSYNC
CLK
加载
(看 便条 1)
f/
C
EF1
CSYNC
CLK
加载
(看 便条 1)
f/
C
V
CC
脉冲波
发生器
C1
C2
X1
X2
CLK
加载
(看 便条 1)
加载
(看 便条 2)
CSYNC
f/
C
AEN2
脉冲波
发生器
触发
V
CC
24MHz
准备好
OSC
AEN1
RDY2
EF1
CLK
加载
(看 便条 1)
f/
C
V
CC
脉冲波
发生器
CSYNC
RDY2
AEN2
加载
(看 便条 2)
AEN1
准备好
触发
脉冲波
发生器
1.5v 1.5v
V
OL
V
IL
- 0.4v
输入
V
IH
+ 0.4v
输出
V
OH
便条: 输入 测试 信号 必须 转变 在 v
IL
(最大) -0.4v 和 v
IH
(最小) +0.4v. res 和 f/c 必须 转变 在 0.4v 和
V
CC
-0.4v. 输入 上升 和 下降 时间 驱动 在 1ns/v. v
IL
≤
V
IL
(最大值) -0.4v 为 csync 管脚. v
CC
-4.5v 和 5.5v.
82C84A
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