DM74LS962N_集成电路资料查询网

切换 特性
V
CC
e
5V 和 T
一个
e
25

C
标识 参数 情况 最小值 最大值 单位
f
最大值
最大 时钟 频率 25 MHz
t
PLH
传播 延迟 Time 低-至-高-水平的
733 ns
从 时钟 至 任何 输出
t
PHL
传播 延迟 Time 高-至-低 水平的
10 48 ns
从 时钟 至 任何 输出 C
L
e
15 pF R
L
e
1k
X
t
使能
使能 时间 从 任何 控制 输入 5 30 ns
t
使不能运转
使不能运转 时间 从 任何 控制 输入 6 30 ns
t
ZH
输出 使能 时间 至 高 水平的 5 23 ns
t
ZL
输出 使能 至 低 水平的 4 18 ns
t
HZ
输出 使不能运转 时间 从 高 水平的
C
L
e
5 pF R
L
e
1k
X
523 ns
t
LZ
输出 使不能运转 时间 从 低 水平的 6 27 ns
逻辑 图解
TLF6438–2
3

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切换特性 V CC e 5V 和 T 一个 e 25  C 标识参数情况最小值最大值单位 f 最大值最大时钟频率 25 MHz t PLH 传播延迟 Time 低-至-高-水平的 733 ns 从时钟至任何输出 t PHL 传播延迟 Time 高-至-低水平的 10 48 ns 从时钟至任何输出 C L e 15 pF R L e 1k X t 使能使能时间从任何控制输入 5 30 ns t 使不能运转使不能运转时间从任何控制输入 6 30 ns t ZH 输出使能时间至高水平的 5 23 ns t ZL 输出使能至低水平的 4 18 ns t HZ 输出使不能运转时间从高水平的 C L e 5 pF R L e 1k X 523 ns t LZ 输出使不能运转时间从低水平的 6 27 ns 逻辑图解 TLF6438–2 3

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