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资料编号:979917
 
资料名称:DS90CR481VJD
 
文件大小: 904K
   
说明
 
介绍:
48-Bit LVDS Channel Link SER/DES − 65 - 112 MHz
 
 


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传输者 切换 特性
推荐 运行 供应 温度 范围 除非 否则 指定.
标识 参数 最小值 典型值 最大值 单位
LLHT LVDS 低-至-高 转变 时间, (
图示 2
),
= 0.75v (无能)
0.14 0.7 ns
LVDS 低-至-高 转变 时间, (
图示 2
),
= Vcc (最大值)
0.11 0.6 ns
LHLT LVDS 高-至-低 转变 时间, (
图示 2
),
= 0.75v (无能)
0.16 0.8 ns
LVDS 高-至-低 转变 时间, (
图示 2
),
= Vcc (最大值)
0.11 0.7 ns
TBIT 传输者 宽度 f = 66 mhz,
112MHz
1/7 TCIP ns
TPPOS 传输者 脉冲波 Positions -
Normalized
f=65to112
MHz
200 0 +200 ps
TJCC Tranmitter Jitter - 循环-至-循环 100 ps
TCCS TxOUT 频道 频道 Skew 40 ps
TSTC TxIN 建制 TxCLK 在, (
图示 5
) 2.5 ns
THTC TxIN 支撑 TxCLK 在, (
图示 5
)0 ns
TPDL 传输者 传播 延迟 - latency, (
图示 7
) 1.5(tcip)+3.72 1.5(tcip)+4.4 1.5(tcip)+6.24 ns
TPLLS 传输者 阶段 循环 设置, (
图示 9
)10ms
TPDD 传输者 Powerdown 延迟, (
图示 11
) 100 ns
接受者 切换 特性
推荐 运行 供应 温度 范围 除非 否则 指定.
标识 参数 最小值 典型值 最大值 单位
CLHT cmos/ttl 低-至-高 转变 时间, Rx 数据 输出,
(
图示 3
)
2.0 ns
cmos/ttl 低-至-高 转变 时间, Rx 时钟
输出, (
图示 3
)
1.0 ns
CHLT cmos/ttl 高-至-低 转变 时间, Rx 数据 输出,
(
图示 3
)
2.0 ns
cmos/ttl 高-至-低 转变 时间, Rx 时钟
输出, (
图示 3
)
1.0 ns
RCOP RxCLK 输出 时期, (
图示 6
) 8.928 T 15.38 ns
RCOH RxCLK 输出 时间, (
图示 6
),
(便条 4)
f = 112 MHz 3.5 ns
f = 66 MHz 6.0 ns
RCOL RxCLK 输出 时间, (
图示 6
),
(便条 4)
f = 112 MHz 3.5 ns
f = 66 MHz 6.0 ns
RSRC RxOUT 建制 RxCLK
输出,(
图示 6
)
f = 112 MHz 2.4 ns
f = 66 MHz 3.6 ns
RHRC RxOUT 支撑 RxCLK 输出,
(
图示 6
), (便条 4)
f = 112 MHz 3.4 ns
f = 66 MHz 6.0 ns
RPDL 接受者 传播 延迟 - latency, (
图示 8
) 3(tcip)+4.0 3(tcip)+4.8 3(tcip)+6.5 ns
RPLLS 接受者 阶段 循环 设置, (
图示 10
)10ms
RPDD 接受者 Powerdown 延迟, (
图示 12
)1µs
ds90cr481/ds90cr482
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