400 msps 14-位, 1.8 v cmos
直接 数字的 synthesizer
AD9954
rev.
0
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特性
400 msps 内部的 时钟 速
整体的 14-位 dac
可编程序的 阶段/振幅 dithering
32-位 tuning 文字
阶段 噪音 ≤ –120 dbc/hz @ 1 khz 补偿 (dac 输出)
极好的 动态 效能
>80 db sfdr @ 160 mhz (±100 khz 补偿) 一个
输出
串行 i/o 控制
ultrahigh 速 相似物 比较器
自动 直线的 和 非线性的 频率 sweeping
能力
4 频率/阶段 补偿 profiles
1.8 v 电源 供应
软件 和 硬件 控制 电源-向下
48-含铅的 tqfp/ep 包装
整体的 1024 文字 × 32-位 内存
支持 为 5 v 输入 水平 在 大多数 数字的 输入
pll refclk 乘法器 (4× 至 20×)
内部的 振荡器, 能 是 驱动 用 一个 单独的 结晶
阶段 调制 能力
multichip 同步
产品
agile lo 频率 综合
可编程序的 时钟 发生器
fm chirp 源 为 radar 和 scanning 系统
automotive radar
测试 和 度量 设备
acousto-optic 设备 驱动器
函数的 块 图解
频率
ACCUMULATOR
静态的 内存
1024
×
32
cos(x)
控制 寄存器
振荡器/缓存区
比较器
同步
使能
i/o 更新
dac_r
设置
dds 核心
阶段
补偿
阶段
ACCUMULATOR
Z
–1
Z
–1
IOUT
IOUT
OSK
PWRDWNCTL
竞赛_输出
竞赛_在
竞赛_在
REFCLK
REFCLK
结晶 输出 i/o portps<1:0>
内存 数据
<31:18>
DDS
时钟
内存
数据
delta 频率 tuning 文字
频率
tuning 文字
内存 数据
dds 时钟
delta 频率 ramp 比率
阶段
ACUMULATOR
重置
DAC
MUX
系统
时钟
系统
时钟
同步_在
同步_clk
重置
定时 和 控制 逻辑
4
×
–20
×
时钟
乘法器
÷ 4
AD9954
3232
32
14
14
14
32
R
一个
M
一个
D
D
R
E
S
S
10
内存 控制
3
19 14
0
32
32
M
U
X
M
U
X
M
U
X
03374-0-001
θ
图示 1. 48-leadtqfp/ep
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