SN74LVC821A
10-位 总线-接口 flip-flop
和 3-状态 输出
scas304f – march 1993 – 修订 六月 1998
1
邮递 办公室 盒 655303
•
达拉斯市, 德州 75265
D
EPIC
(增强-效能 implanted
cmos) submicron 处理
D
典型 v
OLP
(输出 地面 bounce)
< 0.8 v 在 v
CC
= 3.3 v, t
一个
= 25
°
C
D
典型 v
OHV
(输出 v
OH
undershoot)
> 2 v 在 v
CC
= 3.3 v, t
一个
= 25
°
C
D
支持 mixed-模式 信号 运作 在
所有 端口 (5-v 输入/输出 电压 和
3.3-v v
CC
)
D
电源 止 使不能运转 输出, permitting
live 嵌入
D
静电释放 保护 超过 2000 v 每
mil-标准-883, 方法 3015
D
获得-向上 效能 超过 250 毫安 每
jesd 17
D
包装 选项 包含 塑料
小-外形 (dw), shrink 小-外形
(db), 和 薄的 shrink 小-外形 (pw)
包装
描述
这个 10-位 总线-接口 flip-flop 是 设计 为 1.65-v 至 3.6-v v
CC
运作.
这 sn74lvc821a 特性 3-状态 输出 设计 specifically 为 驱动 高级地 电容的 或者 相当地
低-阻抗 负载. 它们 是 特别 合适的 为 implementing wider 缓存区 寄存器, i/o ports,
双向的 总线 驱动器 和 parity, 和 working 寄存器.
这 ten flip-flops 是 边缘-triggered d-类型 flip-flops. 在 这 积极的 转变 的 这 时钟 (clk) input, 这
设备 提供 真实 数据 在 这 q 输出.
一个 缓冲 输出-使能 (oe) 输入 能 是 使用 至 放置 这 ten 输出 在 也 一个 正常的 逻辑 状态 (高
或者 低 逻辑 水平) 或者 一个 高-阻抗 状态. 在 这 高-阻抗 state, 这 输出 neither 加载 也不 驱动
这 总线 线条 significantly. 这 高-阻抗 状态 和 增加 驱动 提供 这 能力 至 驱动 总线 线条
没有 接口 或者 pullup 组件.
OE
做 不 影响 这 内部的 行动 的 这 获得. 先前 贮存 数据 能 是 retained 或者 新 数据 能
是 entered 当 这 输出 是 在 这 高-阻抗 状态.
输入 能 是 驱动 从 也 3.3-v 或者 5-v 设备. 这个 特性 准许 这 使用 的 这些 设备 作 翻译
在 一个 mixed 3.3-v/5-v 系统 环境.
至 确保 这 高-阻抗 状态 在 电源 向上 或者 电源 向下, oe
应当 是 系 至 v
CC
通过 一个 pullup
电阻; 这 最小 值 的 这 电阻 是 决定 用 这 电流-sinking 能力 的 这 驱动器.
这 sn74lvc821a 是 典型 为 运作 从 –40
°
c 至 85
°
c.
版权
1998, 德州 器械 组成公司的
生产 数据 信息 是 电流 作 的 发行 日期.
产品 遵从 至 规格 每 这 条款 的 德州 器械
标准 保用单. 生产 处理 做 不 必然地 包含
测试 的 所有 参数.
请 是 知道 那 一个 重要的 注意 涉及 有效性, 标准 保用单, 和 使用 在 核心的 产品 的
德州 器械 半导体 产品 和 免责声明 附之 呈现 在 这 终止 的 这个 数据 薄板.
epic 是 一个 商标 的 德州 器械 组成公司的.
db, dw, 或者 pw 包装
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地
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CLK
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