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dsc-4849/3
i/o
控制
地址
解码器
64Kx16
记忆
排列
70V28
ARBITRATION
中断
SEMAPHORE
逻辑
CE
0L
OE
L
r/
W
L
一个
15L
一个
0L
SEM
L
INT
L
(2)
BUSY
L
(1,2)
LB
L
CE
0L
OE
L
UB
L
i/o
控制
地址
解码器
CE
0R
OE
R
r/
W
R
一个
15R
一个
0R
SEM
R
INT
R
(2)
BUSY
R
(1,2)
LB
R
r/
W
R
OE
R
UB
R
m/
S
(1)
CE
1L
CE
0R
CE
1R
4849 drw 01
i/o
CE
1R
CE
1L
8-15l
i/o
i/o
0-7r
i/o
8-15r
0-7l
r/
W
L
16
16
◆◆
◆◆
◆
m/
S
= v
IH
为
BUSY
输出 标记 在 主控,
m/
S
= v
IL
为
BUSY
输入 在 从动装置
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◆
busy 和 中断 flags
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◆
在-碎片 端口 arbitration 逻辑
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◆
全部 在-碎片 硬件 支持 的 semaphore signaling
在 端口
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◆
全部地 异步的 运作 从 也 端口
◆
独立的 upper-字节 和 更小的-字节 控制 为 multi-
plexed 总线 和 总线 相一致 兼容性
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◆
lvttl-兼容, 单独的 3.3v (±0.3v) 电源 供应
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◆
有 在 一个 100-管脚 tqfp
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◆
工业的 温度 范围 (–40°c 至 +85°c) 是 有
为 选择 speeds
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◆
真实 双-ported 记忆 cells 这个 准许 同时发生的
进入 的 这 一样 记忆 location
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◆
高-速 进入
– 商业的: 15/20ns (最大值.)
– 工业的: 20ns (最大值.)
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◆
低-电源 运作
– IDT70V28L
起作用的: 440mw (典型值.)
备用物品: 660µw (典型值.)
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◆◆
◆
双 碎片 使能 准许 为 depth expansion 没有
外部 逻辑
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◆
idt70v28 容易地 expands 数据 总线 宽度 至 32 位 或者
更多 使用 这 主控/从动装置 选择 当 cascading 更多
比 一个 设备
高-速 3.3v
64k x 16 双-端口
静态的 内存
IDT70V28L
注释:
1.
BUSY
是 一个 输入 作 一个 从动装置 (m/
S
=V
IL
) 和 一个 输出 当 它 是 一个 主控 (m/
S
=V
IH
).
2.
BUSY
和
INT
是 非-触发-状态 totem-柱子 输出 (推-拉).
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