12月 4, 1998 (Version 5.0)
1
9
特性
•5 ns 管脚-至-管脚 逻辑delays 在 所有 管脚
•f
CNT
to 100 mhz
•36 macrocells 和 800 usable 门
•向上 至34 美国er i/o pins
•5 v 在-系统 程序m能 (isp)
-Endurance的 10,000 程序/擦掉 cycles
-程序/擦掉over 全部 商业的 电压 和
温度 范围
•增强 管脚-locking architecture
•有伸缩性的 36v18 函数B锁
-90 产品 条款 驱动 任何 或者 所有 的 18 macrocells
在里面 函数 块
-Glob一个l 一个d产品 期 clocks, 输出 使能, 设置
和 reset 信号
•Extensive ieee std1149.1 boundary-sc一个n (jTag)
支持
•可编程序的 电源 reduction 模式 在 各自
macrocell
•回转 比率 控制on individual 输出puts
•用户 progr一个mmable地面p在 能力
•Extended 模式 秒urity 特性 为设计 保护
•高-驱动 24m一个outputs
•3.3 v 或者 5 v i/ocapability
•先进的cmos 5v fastflasHtechnology
•支持 并行的 programming 的 更多 比 一个
xc9500 concurrently
•一个vailable 在 44-管脚 plCc, 44-管脚 vqfP, 和48-管脚
csp 包装一个ges
描述
这 xc9536 是一个 高-performanceCPLD供应
advanced 在-system程序编制 和testcap一个bilities 为
一般目的 逻辑integration. 它 是 包括 的 two
36V18Function blocks, 供应800 usable gates和
prop一个gationdelays的 5 ns. 看Figure2为thearchitec-
tureoverview.
电源 管理
Power 消耗 能 是 减少 在 这 xc9536by config-
uringmacrocells 至 standard 或者低-电源modes 的 opera-
tion. unused macrocells 是 转变edoff 至 minimizepower
消耗.
Operatingcurrent 为 各自 设计 能 是 近似的d为
明确的 运行 conditions 使用 这 following 等式:
I
CC
(毫安)=
MC
HP
(1.7) + mc
LP
(0.9) + mc (0.006 毫安/mHz) f
在哪里:
MC
HP
= macrocells 在 high-每formance 模式
MC
LP
= macrocells 在 low-power 模式
mc =Total 号码of macrocells使用
f = 时钟 频率 (mhz)
Figure1显示 一个typical 计算 为 这 xc9536 设备.
1
xc9536 在-系统 可编程序的
CPLD
12月 4, 1998 (version 5.0)
11*
产品Specification
时钟 频率 (mhz)
典型 i
CC
(毫安)
050
(50)
(30)
(83)
(50)
100
高 效能
低 电源
X5920
图示 1:Typical i
CC
vs. 频率 为 xc9536
: 点此下载
