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资料编号:992192
 
资料名称:IDT71V3577S85PFG
 
文件大小: 521K
   
说明
 
介绍:
128K X 36, 256K X 18 3.3V Synchronous SRAMs 3.3V I/O, Flow-Through Outputs Burst Counter, Single Cycle Deselect
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个

dsc-5280/08
1
©2005 整体的 设备 技术, 公司

128k x 36, 256k x 18 记忆 配置
◆◆
◆◆
支持 快 进入 时间:
商业的:
7.5ns 向上 至 117mhz 时钟 频率
商业的 和 工业的:
8.0ns 向上 至 100mhz 时钟 频率
8.5ns 向上 至 87mhz 时钟 频率
LBOLBO
LBOLBO
LBO
输入 选择 interleaved 或者 直线的 burst 模式
◆◆
◆◆
使能 (
BWEBWE
BWEBWE
BWE
), 和 字节 写 (
BWBW
BWBW
BW
x)
◆◆
◆◆
3.3v 核心 电源 供应
◆◆
◆◆
电源 向下 控制 用 zz 输入
◆◆
◆◆
3.3v i/o
◆◆
◆◆
optional - boundary scan jtag 接口 (ieee 1149.1
一致的)
◆◆
◆◆
packaged 在 一个 电子元件工业联合会 标准 100-管脚 塑料 薄的 四方形
grid 排列

便条:
1.
BW
3
BW
4
是 不 适用 为 这 idt71v3579.

这 idt71v3577/79 是 高-速 srams 有组织的 作
128k x 36/256k x 18. 这 idt71v3577/79 srams 包含 写, data,
地址 和 控制 寄存器. 那里 是 非 寄存器 在 这 数据 输出
终止 的 这 写 循环.
为 一个 单独的 地址 提交 至 这 sram. 一个 内部的 burst 地址
这 一样 循环. 如果 burst 模式 运作 是 选择 (
ADV
=低), 这
next 三 rising 时钟 edges. 这 顺序 的 这些 三 地址 是
定义 用 这 内部的 burst 计数器 和 这
LBO
输入 管脚.
这 idt71v3577/79 srams utilize idt’s 最新的 高-效能
(bga) 和 一个 165 fine 程度 球 grid 排列 (fbga).
一个
0
-一个
17
地址 输入 输入 同步的

碎片 使能 输入 同步的
CS
0
,

1
碎片Selects Input Synchro美国

输出 使能 输入 异步的

global 写 使能 输入 同步的

字节 写 使能 输入 同步的

1
,

2
,

3
,

4
(1)
Individual 用teSelects 输入 Synchrono美国
CLK Clock Input n/一个

Burst addressAdvance 输入 Synchrono美国

AddressStatus (cacheController) 输入 Synchro美国

Address状态 (processor) Input Synchro美国

直线的 / interleaved burst 顺序 输入 直流
TMS 测试 模式 选择 输入 同步的
TDI Test 数据 input 输入 Synchrono美国
TCK 测试 时钟 输入 n/一个
TDO Test 数据 输出 Output Synchro美国

jtag 重置 (optional) 输入 异步的
ZZ 睡眠 模式 输入 异步的
i/o
0
-i/o
31
, i/o
P1
-i/o
P4
数据 input / output i/o Synchro美国
V
DD
, v
DDQ
CorePo我们r,i/o po我们r Supply n/一个
V
SS
地面 供应 n/一个
5280tbl 01
128k x 36, 256k x 18
3.3v 同步的 srams
3.3v i/o, 流动-通过 输出
burst 计数器, 单独的 循环 deselect
IDT71V3577S
IDT71V3579S
IDT71V3577SA
IDT71V3579SA
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