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资料编号:121108
 
资料名称:AD1674AR
 
文件大小: 255.14K
   
说明
 
介绍:
12-Bit 100 kSPS A/D Converter
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
AD1674
rev. c
–5–
(为 所有 grades t
最小值
至 t
最大值
和 v
CC
= +15 v
10% 或者 +12 v
5%,
V
逻辑
= +5 v
10%, v
EE
= –15 v
10% 或者 –12 v
5%; v
IL
= 0.4 v,
V
IH
= 2.4 v 除非 否则 指出)
切换 规格
转换器 开始 定时 (图示 1)
j, k, 一个, b, grades t 等级
参数 标识 最小值 典型值 最大值 最小值 典型值 最大值 单位
转换 时间
8-位 循环 t
C
78 78
µ
s
12-位 循环 t
C
910 910
µ
s
sts 延迟 从 ce t
DSC
200 225 ns
ce 脉冲波 宽度 t
HEC
50 50 ns
CS
至 ce 建制 t
SSC
50 50 ns
CS
低 在 ce 高 t
HSC
50 50 ns
r/
C
至 ce 建制 t
SRC
50 50 ns
r/
C
低 在 ce 高 t
HRC
50 50 ns
一个
0
至 ce 建制 t
SAC
00ns
一个
0
有效的 在 ce 高 t
HAC
50 50 ns
读 timing—full 控制 模式 (图示 2)
j, k, 一个, b, grades t 等级
参数 标识 最小值 典型值 最大值 最小值 典型值 最大值 单位
进入 时间 t
DD
1
75 150 75 150 ns
数据 有效的 之后 ce 低 t
HD
25
2
25
2
ns
20
3
15
4
ns
输出 float 延迟 t
HL
5
150 150 ns
CS
至 ce 建制 t
SSR
50 50 ns
r/
C
至 ce 建制 t
SRR
00ns
一个
0
至 ce 建制 t
SAR
50 50 ns
CS
有效的 之后 ce 低 t
HSR
00ns
r/
C
高 之后 ce 低 t
HRR
00ns
一个
0
有效的 之后 ce 低 t
HAR
50 50 ns
注释
1
t
DD
是 量过的 和 这 加载 电路 的 图示 3 和 是 定义 作 这 时间
必需的 为 一个 输出 至 交叉 0.4 v 或者 2.4 v.
2
0
°
c 至 t
最大值
.
3
在 –40
°
c.
4
在 –55
°
c.
5
t
HL
是 定义 作 这 时间 必需的 为 这 数据 线条 至 改变 0.5 v 当
承载 和 这 电路 的 图示 3.
所有 最小值 和 最大值 规格 是 有保证的.
规格 主题 至 改变 没有 注意.
测试 V
CP
C
输出
进入 时间 高 z 至 逻辑 低 5 v 100 pf
float 时间 逻辑 高 至 高 z 0 v 10 pf
进入 时间 高 z 至 逻辑 高 0 v 100 pf
float 时间 逻辑 低 至 高 z 5 v 10 pf
t
HEC
CE
STS
db11 – db0
一个
0
CS
__
r/c
_
t
SSC
t
HSC
t
SRC
t
HRC
t
SAC
t
HAC
t
C
t
DSC
高 阻抗
图示 1. 转换器 开始 定时
阻抗
CE
STS
db11 – db0
一个
0
CS
__
r/c
_
t
HSR
t
SSR
t
HRR
t
SAR
t
HAR
t
DD
t
HL
imp.
数据
有效的
t
HD
t
HS
t
SSR
图示 2. 读 定时
V
CP
D
输出
C
输出
I
OH
I
OL
图示 3. 加载 电路 为 总线 定时 规格
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