ADuC834BS_集成电路资料查询网

rev.
P
rc (12 march 2002)
ADuC834
–
15
–
初步的 技术的数据
参数 最小值 典型值 最大值 单位 图示
spi 从动装置 模式 定时 (cpha = 1)
t
SS
SS
至 sclock 边缘 0 ns 9
t
SL
sclock 低 pulsewidth 330 ns 9
t
SH
sclock 高 pulsewidth 330 ns 9
t
DAV
数据 输出 有效的 之后 sclock 边缘 50 ns 9
t
DSU
数据 输入 建制 时间 在之前 sclock 边缘 100 ns 9
t
DHD
数据 输入 支撑 时间 之后 sclock 边缘 100 ns 9
t
DF
数据 输出 下降 时间 10 25 ns 9
t
DR
数据 输出 上升 时间 10 25 ns 9
t
SR
sclock 上升 时间 10 25 ns 9
t
SF
sclock 下降 时间 10 25 ns 9
t
SFS
SS
高 之后 sclock 边缘 0 ns 9
SCLOCK
(cpol = 0)
t
SS
SCLOCK
(cpol = 1)
MISO
MOSI
SS
msb 在
位 6
›
1lsb 在
LSB
位 6
›
1
MSB
t
DHD
t
DSU
t
DF
t
DR
t
SL
t
SH
t
DAV
t
DF
t
SR
t
SF
t
SFS
图示 9. spi 从动装置 模式 定时 (cpha = 1)

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rev. P rc (12 march 2002) ADuC834 – 15 – 初步的技术的数据参数最小值典型值最大值单位图示 spi 从动装置模式定时 (cpha = 1) t SS SS 至 sclock 边缘 0 ns 9 t SL sclock 低 pulsewidth 330 ns 9 t SH sclock 高 pulsewidth 330 ns 9 t DAV 数据输出有效的之后 sclock 边缘 50 ns 9 t DSU 数据输入建制时间在之前 sclock 边缘 100 ns 9 t DHD 数据输入支撑时间之后 sclock 边缘 100 ns 9 t DF 数据输出下降时间 10 25 ns 9 t DR 数据输出上升时间 10 25 ns 9 t SR sclock 上升时间 10 25 ns 9 t SF sclock 下降时间 10 25 ns 9 t SFS SS 高之后 sclock 边缘 0 ns 9 SCLOCK (cpol = 0) t SS SCLOCK (cpol = 1) MISO MOSI SS msb 在位 6 › 1lsb 在 LSB 位 6 › 1 MSB t DHD t DSU t DF t DR t SL t SH t DAV t DF t SR t SF t SFS 图示 9. spi 从动装置模式定时 (cpha = 1)

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