DP83905AVQB_集成电路资料查询网

20 管脚 描述
(持续)
管脚 No 管脚 名字 类型

描述
外部 记忆 支持
(持续)
36 RCS1 O
内存 碎片 选择 1
驱动 这 碎片 选择 的 这 外部 内存 在 这 更小的 half
的 这 记忆 支持 数据 bus
MOS
34 RCS2 O
内存 碎片 选择 2
驱动 这 碎片 选择 的 这 外部 内存 在 这 upper half
的 这 记忆 支持 数据 bus
MOS
38 EECS O
可擦可编程只读存储器 碎片 SELECT
Strobes 数据 从 这 可擦可编程只读存储器 面向 这 记忆 支持
数据 bus
MOS
39 EECONFIG I
配置 从 EEPROM
当 这个 管脚 是 系 高 这 ATLANTIC 控制
负载 这 配置 从 一个 EEPROM
TTL
12 BSCLK I
内部的 总线 CLOCK
这个 控制 这 速 的 这 NIC 核心 如果 它 是 不 运动
止 的 一个 内部的 时钟 (看 配置 寄存器 c) 这个 管脚 应当 是 系 至
TTL
地面 如果 它 是 unused
低 电源 支持
62 LOWPWR I
低 POWER
Instructs ATLANTIC 控制 至 enter 它的 低 电源 mode 作
详细地 在 部分 45 应当 是 系 至 地面 为 正常的 operation
TTL
测试 支持
11 测试 I
TEST
这个 输入 是 仅有的 使用 为 测试 mode 它 应当 是 left unconnected 作 它 有
一个 内部的 拉-向下 电阻 这个 将 使能 准确无误的 operation
MOS
电源 供应 管脚
160 PLLV
CC
PLL 5V 供应 PINS
这个 管脚 供应 5V 至 这 ATLANTIC’s 相似物 PLL inside
这 ENDEC block 至 maximize 数据 恢复 它 是 推荐 那 相似物 布局
和 解耦 rules 是 应用 在 这个 管脚 和 PLLGND
159 PLLGND
PLL 负的 (地面) 供应 管脚
157 152 PV
CC
物理的 媒介 5V 供应 PINS
这些 管脚 供应 5V 至 这 ATLANTIC’s
相似物 物理的 媒介 接口 circuitry
144 143
139
158 149 PGND
物理的 LAYER 负的 (地面) 供应 PINS
这些 管脚 是 这
地面 至 这 ATLANTIC’s 相似物 物理的 媒介 接口 circuitry
140 138
9OV
CC
OSClLLATOR 5V 供应 PINS
这个 管脚 供应 5V 至 这 ATLANTIC’s 振荡器
和 LED circuitry
6 OGND
振荡器 负的 (地面) 供应 PINS
这个 管脚 是 这 地面 至 这
ATLANTIC’s 振荡器 和 LED circuitry
59 49 V
CC
积极的 5V 供应 PINS
这些 管脚 供应 电源 至 这 ATLANTIC
Controller’s logic
24 13
60 54 44 地
负的 (地面) 供应 PINS
这些 是 这 供应 管脚 为 这
ATLANTIC Controller’s logic 它 是 建议的 那 解耦 电容 是
35 23 14
连接 在 这 V
CC
和 地 pins 它 是 essential 至 提供 一个 path 至 地面
为 这 地 管脚 和 这 最低 可能 impedance
132 121 IFV
CC
接口 积极的 5V 供应 PINS
这些 管脚 供应 电源 至 这
ATLANTIC Controller’s ISA interface
107 87 68
135 129 lFGND
接口 负的 (地面) 供应 PINS
这些 是 这 供应 管脚 为
这 ATLANTIC Controller’s ISA interface 它 是 建议的 那 解耦 电容
125 124
是 连接 在 这 IFV
CC
和 IFGND pins 它 是 essential 至 提供 一个 path 至
116 98
地面 为 这 IFGND 管脚 和 这 最低 可能 impedance
85 71 65

驱动器 类型 are I
e
Input O
e
Output IO
e
bi-directional Output OCH
e
打开 Collector 3SH
e
触发-状态 Output TTL
e
TTL Compatible AUI
e
Attachment 单位 Interface TPI
e
Twisted 一双 Interface LED
e
LED Drive MOS
e
CMOS 水平的 Compatible XTAL
e
Crystal
7

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20 管脚描述 (持续) 管脚 No 管脚名字类型  描述外部记忆支持 (持续) 36 RCS1 O 内存碎片选择 1 驱动这碎片选择的这外部内存在这更小的 half 的这记忆支持数据 bus MOS 34 RCS2 O 内存碎片选择 2 驱动这碎片选择的这外部内存在这 upper half 的这记忆支持数据 bus MOS 38 EECS O 可擦可编程只读存储器碎片 SELECT Strobes 数据从这可擦可编程只读存储器面向这记忆支持数据 bus MOS 39 EECONFIG I 配置从 EEPROM 当这个管脚是系高这 ATLANTIC 控制负载这配置从一个 EEPROM TTL 12 BSCLK I 内部的总线 CLOCK 这个控制这速的这 NIC 核心如果它是不运动止的一个内部的时钟 (看配置寄存器 c) 这个管脚应当是系至 TTL 地面如果它是 unused 低电源支持 62 LOWPWR I 低 POWER Instructs ATLANTIC 控制至 enter 它的低电源 mode 作详细地在部分 45 应当是系至地面为正常的 operation TTL 测试支持 11 测试 I TEST 这个输入是仅有的使用为测试 mode 它应当是 left unconnected 作它有一个内部的拉-向下电阻这个将使能准确无误的 operation MOS 电源供应管脚 160 PLLV CC PLL 5V 供应 PINS 这个管脚供应 5V 至这 ATLANTIC’s 相似物 PLL inside 这 ENDEC block 至 maximize 数据恢复它是推荐那相似物布局和解耦 rules 是应用在这个管脚和 PLLGND 159 PLLGND PLL 负的 (地面) 供应管脚 157 152 PV CC 物理的媒介 5V 供应 PINS 这些管脚供应 5V 至这 ATLANTIC’s 相似物物理的媒介接口 circuitry 144 143 139 158 149 PGND 物理的 LAYER 负的 (地面) 供应 PINS 这些管脚是这地面至这 ATLANTIC’s 相似物物理的媒介接口 circuitry 140 138 9OV CC OSClLLATOR 5V 供应 PINS 这个管脚供应 5V 至这 ATLANTIC’s 振荡器和 LED circuitry 6 OGND 振荡器负的 (地面) 供应 PINS 这个管脚是这地面至这 ATLANTIC’s 振荡器和 LED circuitry 59 49 V CC 积极的 5V 供应 PINS 这些管脚供应电源至这 ATLANTIC Controller’s logic 24 13 60 54 44 地负的 (地面) 供应 PINS 这些是这供应管脚为这 ATLANTIC Controller’s logic 它是建议的那解耦电容是 35 23 14 连接在这 V CC 和地 pins 它是 essential 至提供一个 path 至地面为这地管脚和这最低可能 impedance 132 121 IFV CC 接口积极的 5V 供应 PINS 这些管脚供应电源至这 ATLANTIC Controller’s ISA interface 107 87 68 135 129 lFGND 接口负的 (地面) 供应 PINS 这些是这供应管脚为这 ATLANTIC Controller’s ISA interface 它是建议的那解耦电容 125 124 是连接在这 IFV CC 和 IFGND pins 它是 essential 至提供一个 path 至 116 98 地面为这 IFGND 管脚和这最低可能 impedance 85 71 65  驱动器类型 are I e Input O e Output IO e bi-directional Output OCH e 打开 Collector 3SH e 触发-状态 Output TTL e TTL Compatible AUI e Attachment 单位 Interface TPI e Twisted 一双 Interface LED e LED Drive MOS e CMOS 水平的 Compatible XTAL e Crystal 7

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