+2.5 v 至 +5.5 v, 25 mhz 低 电源
cmos 完全 dds
初步的
Technical
数据
AD9833
特性
+2.3 v 至 +5.5 v 电源 供应
25 mhz 速
tiny 10-管脚
µµ
µµ
µ
soic 包装
串行 加载
sinusoidal/triangular dac 输出
电源-向下 选项
narrowband sfdr > 72 db
20 mw 电源 消耗量 在 3 v
产品
数字的 调制
可携带的 设备
测试 设备
dds tuning
串行 接口
&放大;
控制 逻辑
SCLK
SDATA
FSYNC
控制 寄存器
PHASE1 REG
PHASE0 REG
MUX
SIN
只读存储器
Σ
10-位 DAC
竞赛
FullScale
控制
MUX
FREQ0 REG
MCLK
FREQ1 REG
12
在-板
涉及
AGND
DGND
VDD
AD9833
阶段
Accumulator
(28 位)
调整器
cap/2.5v
2.5v
avdd/
DVDD
VOUT
MUX
DIV 用
2
MSB
MUX
R
200
Ω
函数的 块 图解
一般 描述
这个 低 电源 dds 设备 是 一个 numerically 控制
振荡器 employing 一个 阶段 accumulator, 一个 sin 只读存储器
和 一个 10-位 d/一个 转换器 整体的 在 一个 单独的
cmos 碎片. 时钟 比率 向上 至 25 mhz 是 supported
和 一个 电源 供应 从 +2.3 v 至 +5.5 v.
能力 为 阶段 调制 和 频率 modula-
tion 是 提供. 频率 精度 能 是 控制 至
一个 部分 在 0.25 billion. 调制 是 effected 用 加载
寄存器 通过 这 串行 接口.
这 ad9833 提供 一个 多样性 的 输出 波形 从
这 vout 管脚. 这 sin 只读存储器 能 是 绕过 所以 那 一个
直线的 向上/向下 ramp 是 输出 从 这 dac. 如果 这 sin
只读存储器 是 不 用-passed, 一个 sinusoidal 输出 是 有.
也, 如果 一个 时钟 输出 是 必需的, 这 msb 的 这 dac
数据 能 是 输出.
这 数字的 部分 是 内部 运作 在 +2.5 v, irre-
spective 的 这 值 的 vdd, 用 一个 在 板 调整器
这个 步伐 向下 vdd 至 +2.5 v, 当 vdd 超过
+2.5 v.
这 ad9833 有 一个 电源-向下 函数 (睡眠). 这个
准许 sections 的 这 设备 这个 是 不 正在 使用 至
是 powered 向下, 因此 minimising 这 电流 consump-
tion 的 这 部分 e.g 这 dac 能 是 powered 向下 当 一个
时钟 输出 是 正在 发生.
这 ad9833 是 有 在 一个 10-管脚
µ
soic 包装.
初步的 技术的数据
rev prg 02/02
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