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DAC5675
SLAS352B
–
12月 2001
–
修订 六月 2002
8
www.德州仪器.com
时钟 输入 和 定时 (持续)
CLK
d[13:0]a
dac 输出
iout1/iout2
0.1%
0.1%
50%
有效的 数据
50%50%50% 50%50%
90%
10%
CLKC
d[13:0]b
t
su(d)
t
h(d)
t
d(d)
= 1/f
CLK
t
w(l)
t
s(dac)
t
pd
t
r(iout)
t
w(h)
图示 5. 定时 图解
AVDD
CLK
内部的
数字的 在
CLKC
AGND
R1
1 k
Ω
DAC5675
R1
1 k
Ω
R2
2 k
Ω
R2
2 k
Ω
R
T
200
Ω
CLK
1:4
CLKC
末端 电阻
摆动 限制
DAC5675
optional, 将 是 绕过
C
交流
0.1
µ
F
图示 6. 时钟 相等的 输入

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DAC5675 SLAS352B – 12月 2001 – 修订六月 2002 8 www.德州仪器.com 时钟输入和定时 (持续) CLK d[13:0]a dac 输出 iout1/iout2 0.1% 0.1% 50% 有效的数据 50%50%50% 50%50% 90% 10% CLKC d[13:0]b t su(d) t h(d) t d(d) = 1/f CLK t w(l) t s(dac) t pd t r(iout) t w(h) 图示 5. 定时图解 AVDD CLK 内部的数字的在 CLKC AGND R1 1 k Ω DAC5675 R1 1 k Ω R2 2 k Ω R2 2 k Ω R T 200 Ω CLK 1:4 CLKC 末端电阻摆动限制 DAC5675 optional, 将是绕过 C 交流 0.1 µ F 图示 6. 时钟相等的输入

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