函数 描述
电源 供应
这
ICS1660
是 设计 至 是 powered 用 一个 标准 9.0 volt
电池. 这 碎片 包含 一个 电压 调整器 那 powers
外部 电路系统 和 提供 这 供应 电压 为 所有 数字的
i/o 在 这 电路. 这个 准许 容易 接口 在 这
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和 其它 标准 逻辑 working 在 5.0v. 这个 regu-
lator 有 短的 电路 保护 和 需要 一个 外部 fil-
ter/补偿 电容 和 一个 最小 值 的 10uf.
在 这 事件 那 一个 外部 管制 5.0v 供应 是 有,
这 v
在
和 v
DD
管脚 能 是 短接 至 准许 这 全部 系统
至 工作 从 一个 一般 供应.
一个 低 电池 发现 电路 是 提供. 这个 电路 是
设计 为 一个 典型 trip 要点 的 6.0v 和 hysteresis 的 关于
200mv 在之上 这 trip 要点. 这个 信号 是 低 起作用的 和 是
多路复用 至 这 fskbat 输出 管脚 当 这 pwr 输入 是
低.
在 一个 努力 至 保持 电源 消耗 至 一个 最小 和 扩展
电池 生命, 大多数 的 这 相似物 电路 是 转变 止 当 这
电路 是 在 rest waiting 为 一个 环绕 发现, (pwr 管脚 低).
在 这个 时间 仅有的 这 调整器, 低 电池 发现, 谈及-
ence 发生器, 和 环绕 发现 电路 是 起作用的. 当 这
pwr 管脚是 高,所有 电路 是 起作用的.
环绕 发现
作 显示 在 这 连结 块 图解, 这 linea 和
lineb 输入 应当 是 连接 至 这 电话 线条
通过 外部 82k
Ω
电阻器 和 0.1uf 电容. 这个
提供 直流 分开 和 sets 向上 一个 电压 分隔物 和 inter-
nal 电阻器 那 将 发现 35.0v rms 典型地. 这个 电压
是 应用 横过 这 linea 和 lineb 输入. 这 设计
值 的 这 内部的 电阻器 是 8.1k
Ω
±
20% 和 相关的
精度 的 2%. 这 环绕 输出 是 高 起作用的.
差别的 front 终止
作 显示 在 这 连结 块 图解, 这 linea 和
lineb 输入 go 在 一个 差别的 放大器 这个 在 转变
驱动 一个 过滤. 所有 电阻器 是 内部的 至 这 碎片 当
电容 是 连接 作 显示 在 这 块 图解. 之后
过滤, 这 信号 是 交流 结合 在 一个 高 增益 放大器
那 converts 这 信号 至 数字的. 这个 数字的 信号 在 转变 acts
作 这 涉及 频率 为 这 阶段 比较器 section 的
这 阶段 锁 循环.
fsk demodulation
之后 这 信号 从 这 电话 线条 有 被 filtered,
amplified 和 转变 至 数字的, 它 acts 作 一个 输入 至 一个 阶段
锁 循环. 这个 pll 做 fsk demodulation. 这 summing
放大器 显示 在 这 块 图解 提供 一个 信号 至 这
vco 那 应当 是 关于 0.5v 为 mark 频率
(1200 hz), 和 2.0v 为 空间 频率 (2200 hz).
作 显示 在 这 块 图解, 这 lfilter (循环 过滤)
输出 有 一个 邮递 过滤 连结 至 它. 这个 postf 信号 是 sent
至 一个 比较器. 这 其它 一侧 的 这 比较器 是 设置 至
大概 2.5v. 这个 比较器 有 一个 小 数量
(200mv) 的 hysteresis 和 它的 输出 是 这 demodulated fsk
数据. 这 fsk 输出 是 高 为 mark 频率 和 低 为
空间 频率. fsk 数据 是 多路复用 输出 的 这
fskbat 管脚 当 这 pwr 输入 是 高.
这 vco 频率 是 设置 和 一个 外部 电阻 和 一个
值 在 这 范围 的 300k 为 一个 中心 频率 的 1700 hz.
这 锁 范围 将 是 660 hz 至 2630 hz 典型. 这 中心
频率 reproducibility 将 是
±
15%. 这 中心 频率
能 是 调整 在 这 系统 用 连接 ampin 至 vss,
pwr 至 vdd, 和 调整 这 外部 电阻 为 1700 hz.
这个 频率 能 是 observed 在 这lfilter 输出 或者 这
fsk/bat 输出.
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