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半导体 公司
g52069-0, rev 4.3 页 5
05/11/01
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数据 薄板
vsc8061/vsc8062
多路调制器/demultiplexer chipset
2.5gb/s 16-位
vsc8062 demultiplexer 交流 特性
(在 推荐 运行 范围)
图示 6:
vsc8062 定时 图解
表格 2: vsc8062 交流 特性
注释: (1) 如果 t
CLK
改变, 所有 remaining 参数 改变 作 表明 用 这 equations.
(2) t
SU
和 t
H
是 建制 和 支撑 时间 的 这 串行 数据 输入 寄存器.
(3) 在 t
CLK
= 400ps.
参数 描述 最小值 典型值 最大值 单位 情况
t
CLK
时钟 时期
(1)
400 ps
t
D
字节 clk16 时期 (t
CLK
x 16) 6.4 ns
t
DSU
clk16 下落 边缘 输出 至 有效的 数据 1.0 3.0 ns
t
DH
阶段 余裕
=
串行 数据 阶段 定时 余裕 和 遵守 至
高-速 时钟
(2)
180
(3)
degrees
t
CLK
高-速 差别的 时钟 输入
clk (clkn)
高-速 串行 数据 输入
di (din)
并行的 数据 时钟 输出
CLK16
D0
D1
D15
t
D
t
BD
DemultiplexedP一个r一个llel
D一个t一个Outputs
t
D
1
t
SU
t
H
+
t
CLK
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