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ADS8344
标识 描述 最小值 典型值 最大值 单位
t
ACQ
acquisition 时间 1.7
µ
s
t
DS
din 有效的 较早的 至 dclk rising 50 ns
t
DH
din 支撑 之后 dclk 高 10 ns
t
做
dclk 下落 至 dout 有效的 100 ns
t
DV
cs 下落 至 dout 使能 70 ns
t
TR
cs rising 至 dout 无能 70 ns
t
CSS
cs 下落 至 第一 dclk rising 50 ns
t
CSH
cs rising 至 dclk ignored 0 ns
t
CH
dclk 高 150 ns
t
CL
dclk 低 150 ns
t
BD
dclk 下落 至 busy rising 100 ns
t
BDV
cs 下落 至 busy 使能 70 ns
t
BTR
cs rising 至 busy 无能 70 ns
图示 7. 完美的 输入 电压 和 输出 代号.
表格 vii. 定时 规格 (+v
CC
= +4.75v 至
+5.25v, t
一个
= –40
°
c 至 +85
°
c, c
加载
= 50pf).
输出 代号
0V
fs = 全部-规模 电压 = v
REF
1 lsb = v
REF
/65,536
fs – 1 lsb
11...111
11...110
11...101
00...010
00...001
00...000
1 lsb
便条
(1)
: 电压 在 转换器 输入, 之后
多路调制器: +in–(–在). (看 图示 2.)
输入 电压
(1)
(v)
数据 format
这 ads8344 输出 数据 是 在 笔直地 二进制的 format 作
显示 在 图示 7. 这个 图示 显示 这 完美的 输出 代号
为 这 给 输入 电压 和 做 不 包含 这 影响
的 补偿, 增益, 或者 噪音.
电源 消耗
那里 是 三 电源 模式 为 这 ads8344: 全部 电源
(pd1 - pd0 = 11b), 自动 电源-向下 (pd1 - pd0 = 00b),
和 关闭 (shdn 低). 这 影响 的 这些 模式
varies 取决于 在 如何 这 ads8344 是 正在 运作.
为 例子, 在 全部 转换 比率 和 24-clocks 每
转换, 那里 是 非常 little 区别 在 全部 电源
模式 和 自动 电源-向下, 一个 关闭 (shdn 低) 将
不 更小的 电源 消耗
当 运行 在 全部-速 和 24-clocks 每 转换
(作 显示 在 图示 3), 这 ads8344 spends 大多数 的 它的 时间
acquiring 或者 converting. 那里 是 little 时间 为 自动 电源-
向下, 假设 那 这个 模式 是 起作用的. 因此, 这 differ-
ence 在 全部 电源 模式 和 自动 电源-向下 是
negligible. 如果 这 转换 比率 是 decreased 用 simply
slowing 这 频率 的 这 dclk 输入, 这 二 模式
仍然是 大概 equal. 不管怎样, 如果 这 dclk fre-
quency 是 保持 在 这 最大 比率 在 一个 转换, 但是
conversions 是 simply 完毕 较少 常常, 然后 这 区别
在 这 二 模式 是 dramatic. 在 这 latter 情况, 这
转换器 spends 一个 增加 percentage 的 它的 时间 在
电源-向下 模式 (假设 这 自动 电源-向下 模式 是
起作用的).
如果 dclk 是 起作用的 和 cs 是 低 当 这 ads8344 是 在
自动 电源-向下 模式, 这 设备 将 continue 至 dissipate
一些 电源 在 这 数字的 逻辑. 这 电源 能 是 减少
至 一个 最小 用 keeping cs 高.
运行 这 ads8344 在 自动 电源-向下 模式 将
结果 在 这 最低 电源 消耗, 和 那里 是 非
转换 时间 “penalty” 在 电源-向上. 这 非常 第一
转换 将 是 有效的. shdn 能 是 使用 至 强迫 一个
立即的 电源-向下.
噪音
这 噪音 floor 的 这 ads8344 它自己 是 极其 低, 作
能 是 seen 从 计算数量 8 thru 11, 和 是 更 更小的 比
competing 一个/d 转换器. 这 ads8344 是 测试 在 两个都
5v 和 2.7v 和 在 两个都 这 内部的 和 外部 时钟
模式. 一个 低 水平的 直流 输入 是 应用 至 这 相似物 输入
管脚 和 这 转换器 是 放 通过 5,000 conversions.
这 数字的 输出 的 这 一个/d 转换器 将 相异 在 输出
代号 预定的 至 这 内部的 噪音 的 这 ads8344. 这个 是 真实
为 所有 16-位 sar-类型 一个/d 转换器. 使用 一个 histogram
至 plot 这 输出 代号, 这 分发 应当 呈现 bell-
shaped 和 这 顶峰 的 这 bell 曲线 representing 这
名义上的 代号 为 这 输入 值. 这
±
1
σ
,
±
2
σ
, 和
±
3
σ
distributions 将 代表 这 68.3%, 95.5%, 和 99.7%,
各自, 的 所有 代号. 这 转变 噪音 能 是 calcu-
lated 用 dividing 这 号码 的 代号 量过的 用 6 和
这个 将 yield 这
±
3
σ
分发 或者 99.7% 的 所有 代号.
statistically, 向上 至 3 代号 可以 下降 外部 这 分发
当 executing 1000 conversions. 这 ads8344, 和 < 3
输出 代号 为 这
±
3
σ
分发, 将 yield 一个 <
±
0.5lsb
转变 噪音 在 5v 运作. remember, 至 达到 这个
低 噪音 效能, 这 顶峰-至-顶峰 噪音 的 这 输入
信号 和 涉及 必须 是 < 50
µ
v.
图示 8. histogram 的 5000 conversions 的 一个 直流 输入 在 这
代号 转变, 5v 运作 外部 时钟 模式.
代号
4561
24200197
7FFE7FFD 800180007FFF
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