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特性
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高-密度, 高-效能, 用电气-可擦掉的 Complex
可编程序的 逻辑 设备
– 128 Macrocells
– 5 产品 条款 每 macrocell, Expandable 向上 至 40 每 Macrocell
– 84, 100, 160 管脚
– 7.5 ns 最大 管脚-至-管脚 延迟
– 注册 运作 向上 至 125 MHz
– 增强 Routing Resources
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有伸缩性的 逻辑 Macrocell
– d/t/获得 配置 flip-flops
– Global 和 单独的 寄存器 控制 信号
– Global 和 单独的 输出 使能
– 可编程序的 输出 回转 比率
– 可编程序的 输出 打开 集电级 选项
– 最大 逻辑 Utilization 用 Burying 一个 寄存器 在里面 一个 COM 输出
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先进的 电源 管理 特性
– 自动 10 µA 备用物品 为 “L” 版本
– 管脚-控制 1 毫安 备用物品 模式
– 可编程序的 管脚-keeper 输入 和 i/os
– 减少-电源 特性 每 Macrocell
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有 在 商业的 和 工业的 温度 范围
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有 在 84-含铅的 plcc, 100-含铅的 pqfp, 100-含铅的 TQFP 和 160-含铅的 PQFP 包装
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先进的 EE 技术
– 100% 测试
– 完全地 Reprogrammable
– 10,000 程序/擦掉 循环
– 20-年 数据 保持
– 2000V 静电释放 保护
– 200 毫安 获得-向上 免除
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JTAG boundary-scan 测试 至 IEEE 标准. 1149.1-1990 和 1149.1a-1993 Supported
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快 在-系统 Programmability (isp) 通过 JTAG
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pci-一致的
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3.3 或者 5.0v i/o 管脚
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安全 Fuse 特性
增强 特性
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改进 Connectivity (额外的 反馈 routing, Alternate 输入 routing)
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输出 使能 产品 条款
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transparent-获得 模式
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Combinatorial 输出 和 注册 反馈 在里面 任何 Macrocell
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三 Global 时钟 管脚
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ITD (输入 转变 发现) 电路 在 Global clocks, 输入 和 i/o
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快 注册 输入 从 产品 期
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可编程序的 “pin-keeper” 选项
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V
CC
电源-向上 重置 选项
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拉-向上 选项 在 JTAG 管脚 TMS 和 TDI
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先进的 电源 管理 特性
– 边缘-控制 电源-向下 “L”
– 单独的 Macrocell 电源 选项
– 使不能运转 ITD 在 Global clocks, 输入 和 i/o 为 “Z” 部分
高-
效能
EE PLD
ATF1508AS
ATF1508ASL
rev. 0784o–pld–09/02
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