2002 六月 24 6
飞利浦 半导体 产品 规格
I
2
c-总线 autosync deflection 控制 为
pc monitors
TDA4841PS
函数的 描述
horizontal 同步 separator 和 极性 纠正
HSYNC (管脚 15) 是 这 输入 为 horizontal 同步
信号, 这个 能 是 直流-结合 TTL 信号 (horizontal
或者 composite 同步) 和 交流-结合 负的-going video
同步 信号. video syncs 是 clamped 至 1.28 v 和
sliced 在 1.4 v. 这个 结果 在 一个 fixed 绝对 slicing 水平的
的 120 mv related 至 同步 顶.
为 直流-结合 TTL 信号 这 输入 夹紧 电流 是
限制. 这 slicing 水平的 为 ttl 信号 是 1.4 v.
这 separated 同步 信号 (也 video 或者 ttl) 是
整体的 在 一个 内部的 电容 至 发现 和 normalize
这 同步 极性.
normalized horizontal 同步 脉冲 是 使用 作 输入
信号 为 这 vertical 同步 积分器, 这 pll1 阶段
探测器 和 这 频率-锁 循环.
vertical 同步 积分器
normalized composite 同步 信号 从 hsync 是
整体的 在 一个 内部的 电容 在 顺序 至 extract
vertical 同步 脉冲. 这 integration 时间 是 依赖 在
这 horizontal 振荡器 涉及 电流 在 href
(管脚 28). 这 积分器 输出 直接地 triggers 这 vertical
振荡器.
vertical 同步 slicer 和 极性 纠正
Vertical 同步 信号 (ttl) 应用 至 VSYNC (管脚 14) 是
sliced 在 1.4 v. 这 输出 信号 的 这 同步 slicer 是
整体的 在 一个 内部的 电容 至 发现 和 normalize
这 同步 极性. 这 输出 信号 的 vertical 同步
积分器 和 同步 normalizer 是 disjuncted 在之前 它们
是 喂养 至 这 vertical 振荡器.
video 夹紧/vertical blanking 发生器
这 video 夹紧/vertical blanking 信号 在 clbl
(管脚 16) 是 一个 二-水平的 sandcastle 脉冲波 这个 是 特别
合适的 为 video ICs 此类 作 这 TDA488x 家族, 但是 也
为 直接 产品 在 video 输出 stages.
这 upper 水平的 是 这 video 夹紧 脉冲波, 这个 是
triggered 用 这 horizontal 同步 脉冲波. 通过 I
2
c-总线 控制,
也 这 leading 或者 trailing 边缘 能 是 选择 用
设置 控制 位 clamp. 这 宽度 的 这 video 夹紧
脉冲波 是 决定 用 一个 内部的 单独的-shot
多谐振荡器.
这 更小的 水平的 的 这 sandcastle 脉冲波 是 这 vertical
blanking 脉冲波, 这个 是 获得 直接地 从 这 内部的
振荡器 波形. 它 是 started 用 这 vertical 同步 和
stopped 和 这 开始 的 这 vertical scan. 这个 结果 在
最佳的 vertical blanking. 通过 i
2
c-总线 控制, 二
不同的 vertical blanking 时间 是 accessible 用 控制
位 vblk.
blanking 将 是 使活动 continuously, 如果 一个 的 这
下列的 情况 是 真实:
软 开始 的 horizontal 和 b+ 驱动 (电压 在 hpll2
(管脚 30) 牵引的 向下 externally 或者 用 这 i
2
c-总线)
pll1 是 unlocked 当 频率-锁 循环 是 在
搜索 模式
非 horizontal flyback 脉冲 在 hflb (管脚 1)
x-ray 保护 是 使活动
供应 电压 在 v
CC
(管脚 10) 是 低 (看 图.22).
通过 i
2
c-总线 控制, horizontal unlock blanking 能 是
切换 止 用 控制 位 blkdis 当 vertical blanking
是 maintained.
handbook, halfpage
TDA4841PS
MHB604
1
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20
19
18
17
HFLB
XRAY
BOP
BSENS
BIN
BDRV
PGND
HDRV
XSEL
V
CC
EWDRV
VOUT2
VOUT1
VSYNC
FOCUS
HSMOD
HPLL2
HCAP
HBUF
HPLL1
HREF
SGND
VCAP
VREF
VAGC
VSMOD
ASCOR
SDA
HSYNC
CLBL
SCL
HUNLOCK
图.2 管脚 配置.
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