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资料编号:1106135
 
资料名称:LTC1296BCSW
 
文件大小: 384K
   
说明
 
介绍:
Single Chip 12-Bit Data Acquisition System
 
 


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7
ltc1293/ltc1294/ltc1296
129346fs
pi fu ctio s
U
UU
# 管脚 函数 描述
1 – 6 ch0 – ch5 相似物 输入 这 相似物 输入 必须 是 自由 的 噪音 和 遵守 至 agnd.
7 COM 一般 这 一般 管脚 定义 这 零 涉及 要点 为 所有 单独的 结束 输入. 它 必须 是 自由 的 噪音 和 是
通常地 系 至 这 相似物 地面 平面.
8 DGND 数字的 地面 这个 是 这 地面 为 这 内部的 逻辑. 系 至 这 地面 平面.
9V
负的 供应 系 v
至 大多数 负的 潜在的 在 这 电路 (地面 在 单独的 供应 产品).
10 AGND 相似物 地面 agnd 应当 是 系 直接地 至 这 相似物 地面 平面.
11 V
REF
ref. 输入 这 涉及 输入 必须 是 保持 自由 的 噪音 和 遵守 至 agnd.
12 D
数据 输入 这 一个/d 配置 文字 是 shifted 在 这个 输入.
13 D
输出
数字的 数据 输出 这 一个/d 转换 结果 是 shifted 输出 的 这个 输出.
14 CS 碎片 选择 输入 一个 逻辑 低 在 这个 输入 使能 数据 转移.
15 CLK 时钟 这个 时钟 synchronizes 这 串行 数据 转移 和 控制 一个/d 转换 比率.
16 V
CC
积极的 供应 这个 供应 必须 是 保持 自由 的 噪音 和 波纹 用 bypassing 直接地 至 这 相似物 地面 平面.
LTC1293
# 管脚 函数 描述
1 –8 ch0 – ch7 相似物 输入 这 相似物 输入 必须 是 自由 的 噪音 和 遵守 至 agnd.
9 COM 一般 这 一般 管脚 定义 这 零 涉及 要点 为 所有 单独的 结束 输入. 它 必须 是 自由 的 噪音 和 是
通常地 系 至 这 相似物 地面 平面.
10 DGND 数字的 地面 这个 是 这 地面 为 这 内部的 逻辑. 系 至 这 地面 平面.
11 V
负的 供应 系 v
至 大多数 负的 潜在的 在 这 电路 (地面 在 单独的 供应 产品).
12 AGND 相似物 地面 agnd 应当 是 系 直接地 至 这 相似物 地面 平面.
13, 14 REF
, ref
+
ref. 输入 这 涉及 输入 必须 是 保持 自由 的 噪音 和 遵守 至 agnd. 这 一个/d sees 一个 涉及 电压 equal
至 这 区别 在 ref
+
和 ref
.
15 D
数据 输入 这 一个/d 配置 文字 是 shifted 在 这个 输入.
16 D
输出
数字的 数据 输出 这 一个/d 转换 结果 是 shifted 输出 的 这个 输出.
17 CS 碎片 选择 输入 一个 逻辑 低 在 这个 输入 使能 数据 转移.
18 CLK 时钟 这个 时钟 synchronizes 这 串行 数据 转移 和 控制 一个/d converion 比率.
19, 20 AV
cc,
DV
CC
积极的 供应 这些 供应 必须 是 保持 自由 的 噪音 和 波纹 用 bypassing 直接地 至 这 相似物 地面 平面. av
CC
和 dv
CC
必须 是 系 一起.
LTC1294
# 管脚 函数 描述
1 –8 ch0 – ch7 相似物 输入 这 相似物 输入 必须 是 自由 的 噪音 和 遵守 至 agnd.
9 COM 一般 这 一般 管脚 定义 这 零 涉及 要点 为 所有 单独的 结束 输入. 它 必须 是 自由 的 噪音 和 是
通常地 系 至 这 相似物 地面 平面.
10 DGND 数字的 地面 这个 是 这 地面 为 这 内部的 逻辑. 系 至 这 地面 平面.
11 V
负的 供应 系 v
至 大多数 负的 潜在的 在 这 电路 (地面 在 单独的 供应 产品).
12 AGND 相似物 地面 agnd 应当 是 系 直接地 至 这 相似物 地面 平面.
13, 14 REF
, ref
+
ref. 输入 这 涉及 输入 必须 是 保持 自由 的 噪音 和 遵守 至 agnd. 这 一个/d sees 一个 涉及 电压 equal
至 这 区别 在 ref
+
和 ref
.
15 D
数据 输入 这 一个/d 配置 文字 是 shifted 在 这个 输入.
16 D
输出
数字的 数据 输出 这 一个/d 转换 结果 是 shifted 输出 的 这个 输出.
17 CS 碎片 选择 输入 一个 逻辑 低 在 这个 输入 使能 数据 转移.
18 CLK 时钟 这个 时钟 synchronizes 这 串行 数据 转移 和 控制 一个/d 转换 比率.
19 SSO 系统 关闭 系统 关闭 输出 管脚 将 go 低 当 电源 关闭 是 要求.
输出
20 V
CC
积极的 供应 这个 供应 必须 是 保持 自由 的 噪音 和 波纹 用 bypassing 直接地 至 这 相似物 地面 平面.
LTC1296
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