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资料编号:122685
 
资料名称:AD9200
 
文件大小: 338.5K
   
说明
 
介绍:
Complete 10-Bit, 20 MSPS, 80 mW CMOS A/D Converter
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
AD9200
–6–
rev. e
定义 的 规格
integral 非线性 (inl)
integral 非线性 谈及 至 这 背离 的 各自 单独的
代号 从 一个 线条 描绘 从 “zero” 通过 “full scale”. 这
要点 使用 作 “zero” occurs 1/2 lsb 在之前 这 第一 代号 transi-
tion. “full scale” 是 定义 作 一个 水平的 1 1/2 lsb 在之外 这 last
代号 转变. 这 背离 是 量过的 从 这 中心 的
各自 particular 代号 至 这 真实 笔直地 线条.
差别的 非线性 (dnl, 非 missing 代号)
一个 完美的 模数转换器 exhibits 代号 transitions 那 是 exactly 1 lsb
apart. dnl 是 这 背离 从 这个 完美的 值. 它 是 常常
指定 在 条款 的 这 决议 为 这个 非 missing 代号
(nmc) 是 有保证的.
典型 描绘 曲线
代号 补偿
1.0
0.5
–1.0
0 1024128
DNL
256 384 512 640 768 896
0
–0.5
图示 3. 典型 dnl
代号 补偿
1.0
0.5
–1.0
0 1024128
INL
256 384 512 640 768 896
0
–0.5
图示 4. 典型 inl
补偿 错误
这 第一 转变 应当 出现 在 一个 水平的 1 lsb 在之上 “zero.”
补偿 是 定义 作 这 背离 的 这 真实的 第一 代号 transi-
tion 从 那 要点.
增益 错误
这 第一 代号 转变 应当 出现 为 一个 相似物 值 1 lsb
在之上 名义上的 负的 全部 规模. 这 last 转变 应当
出现 为 一个 相似物 值 1 lsb 在下 这 名义上的 积极的 全部
规模. 增益 错误 是 这 背离 的 这 真实的 区别 是-
tween 第一 和 last 代号 transitions 和 这 完美的 区别
在 这 第一 和 last 代号 transitions.
pipeline 延迟 (latency)
这 号码 的 时钟 循环 在 转换 initiation 和
这 有关联的 输出 数据 正在 制造 有. 新 输出
数据 是 提供 每 rising 边缘.
输入 频率 – hz
60
55
20
1.00e+05 1.00e+081.00e+06 1.00e+07
50
45
25
40
35
30
snr– db
–0.5 振幅
–6.0 振幅
–20.0 振幅
图示 5. snr vs. 输入 频率
60
55
20
1.00e+05 1.00e+081.00e+06
sinad – db
1.00e+07
50
45
25
40
35
30
–0.5 振幅
–6.0 振幅
–20.0 振幅
输入 频率 – hz
图示 6. sinad vs. 输入 频率
(avdd = +3 v, drvdd = +3 v, f
S
= 20 mhz (50% 职责 循环), 模式 = avdd, 2 v 输入
span 从 0.5 v 至 2.5 v, 外部 涉及, 除非 否则 noted)
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