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资料编号:122685
 
资料名称:AD9200
 
文件大小: 338.5K
   
说明
 
介绍:
Complete 10-Bit, 20 MSPS, 80 mW CMOS A/D Converter
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
AD9200
–8–
rev. e
表格 i. 模式 选择
输入 输入 模式 REFSENSE
模式 连接 Span 管脚 管脚 REF REFTS REFBS 图示
顶/bottom AIN 1 v AVDD 短的 refsense, refts 和 vref 一起 AGND 18
AIN 2 v AVDD AGND 短的 refts 和 vref 一起 AGND 19
中心 span AIN 1 v avdd/2 短的 vref 和 refsense 一起 avdd/2 avdd/2 20
AIN 2 v avdd/2 AGND 非 连接 avdd/2 avdd/2
差别的 ain 是 输入 1 1 v avdd/2 短的 vref 和 refsense 一起 avdd/2 avdd/2 29
refts 和
refbs 是
短接 一起
为 输入 2 2 v avdd/2 AGND 非 连接 avdd/2 avdd/2
外部 ref AIN 2 v 最大值 AVDD AVDD 非 连接 span = refts 21, 22
– refbs (2 v 最大值)
AGND 短的 至 短的 至 23
VREFTF VREFBF
AD876 AIN 2 v float 或者 AVDD 非 连接 短的 至 短的 至 30
AVSS VREFTF VREFBF
0
–9
1.0e+6 1.0e+910.0e+6
信号 振幅 – db
100.0e+6
–3
–6
频率 – hz
–12
–15
–18
–21
–24
–27
图示 13. 全部 电源 带宽
25
20
–25
0 3.01.0 2.0
15
10
–5
–10
–15
输入 电压 – v
5
0
–20
2.50.5 1.5
I
B
一个
refbs = 0.5v
refts = 2.5v
时钟 = 20mhz
图示 14. 输入 偏差 电流 vs. 输入 电压
应用 这 ad9200
theory 的 运作
这 ad9200 实现 一个 pipelined multistage architecture 至
达到 高 样本 比率 和 低 电源. 这 ad9200 distrib-
utes 这 转换 在 一些 小 一个/d subblocks, refining
这 转换 和 progressively 高等级的 精度 作 它 passes
这 结果 从 平台 至 平台. 作 一个 consequence 的 这 distrib-
uted 转换, 这 ad9200 需要 一个 小 fraction 的 这
1023 comparators 使用 在 一个 传统的 flash 类型 一个/d. 一个
样本-和-支撑 函数 在里面 各自 的 这 stages 准许 这
第一 平台 至 运作 在 一个 新 输入 样本 当 这 第二,
第三 和 fourth stages 运作 在 这 三 preceding 样本.
运算的 模式
这 ad9200 是 设计 至 准许 最优的 效能 在 一个
宽 多样性 的 imaging, communications 和 仪器
产品, 包含 管脚 兼容性 和 这 ad876 一个/d.
至 realize 这个 flexibility, 内部的 switches 在 这 ad9200 是
使用 至 reconfigure 这 电路 在 不同的 模式. 这些 模式
是 选择 用 适合的 管脚 strapping. 那里 是 三 部分
的 这 电路 影响 用 这个 modality: 这 电压 涉及, 这
涉及 缓存区, 和 这 相似物 输入. 这 nature 的 这 appli-
cation 将 决定 这个 模式 是 适合的: 这 descrip-
tions 在 这 下列的 sections, 作 好 作 这 表格 i 应当
assist 在 picking 这 desired 模式.
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