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资料编号:124161
 
资料名称:ADP3181JRQZ-RL
 
文件大小: 541.36K
   
说明
 
介绍:
5-Bit or 6-Bit Programmable 2-,3-,4-Phase Synchronous Buck Controller
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
ADP3181
rev. 一个 | 页 4 的 24
参数 标识 情况 最小值 典型值 最大值 单位
电流 balance 电路
一般 模式 范围 V
sw(x)cm
−600 +200 mv
输入 阻抗 R
sw(x)
sw(x) = 0 v. 20 30 40
k
Ω
输入 电流 I
sw(x)
sw(x) = 0 v. 4 7 10
μ
一个
输入 电流 相一致
Δ
I
sw(x)
sw(x) = 0 v. −5 +5 %
电流 限制 比较器
输出 电压
正常的 模式 V
ilimit(nm)
en > 0.8 v, r
ILIMIT
= 250 k
Ω
.
2.9 3 3.1V
在 关闭 V
ilimit(sd)
en < 0.4 v, i
ILIMIT
= −100
μ
一个.
400 mv
输出 电流, 正常的 模式 I
ilimit(nm)
en > 0.8 v, r
ILIMIT
= 250 k
Ω
.
12
μ
一个
最大 输出 电流
2
60
μ
一个
电流 限制 门槛 电压 V
CL
V
CSREF
– v
CSCOMP
, r
ILIMIT
= 250 k
Ω
.
105 125 145mV
电流 限制 设置 比率 V
CL
/i
ilimit.
10.4
mv/
μ
一个
延迟 正常的 模式 电压 V
延迟(nm)
R
延迟
= 250 k
Ω
.
2.9 3 3.1V
延迟 overcurrent 门槛 V
延迟(oc)
R
延迟
= 250 k
Ω
.
1.7 1.8 1.9V
获得-止 延迟 时间 t
延迟
R
延迟
= 250 k
Ω
, c
延迟
= 12 nf.
1.5ms
软 开始
输出 电流, 软 开始 模式 I
延迟(ss)
在 开始-向上, 延迟 < 2.4 v. 15 20 25
μ
一个
软 开始 延迟 时间 t
延迟(ss)
R
延迟
= 250 k
Ω
, c
延迟
= 12 nf, vid 代号 = 011111.
1ms
使能 输入
输入 低 电压 V
il(en)
0.4 v
输入 高 电压 V
ih(en)
0.8 v
输入 电流, 输入 电压 低 I
il(en)
en = 0 v. −1 1
μ
一个
输入 电流, 输入 电压 高 I
ih(en)
en = 1.25 v. 10 25
μ
一个
电源 好的 比较器
欠压 门槛 V
pwrgd(uv)
相关的 至 名义上的 dac 输出. −180 −250 −320 mV
超(电)压 门槛 V
pwrgd(ov)
相关的 至 名义上的 dac 输出. 230 300 370 mV
输出 低 电压 V
ol(pwrgd)
I
pwrgd(下沉)
= 4 毫安. 225 400 mV
电源 好的 延迟 时间
在 软 开始
2
R
延迟
= 250 k
Ω
, c
延迟
= 12 nf, vid 代号 = 011111.
1 ms
vid 代号 changing 100 250
μ
s
vid 代号 静态的 200 ns
crowbar trip 要点 V
CROWBAR
相关的 至 名义上的 dac 输出. 230 300 370 mV
crowbar 重置 要点 Relative 至 fbrtn. 630 700 770 mV
crowbar 延迟 时间 t
CROWBAR
超(电)压 至 pwm going 低.
vid 代号 changing 100 250
μ
s
vid 代号 静态的 400 ns
pwm 输出
输出 低 电压 V
ol(pwm)
I
pwm(下沉)
= −400
μ
一个.
160 500 mv
输出 高 电压 V
oh(pwm)
I
pwm(源)
= 400
μ
一个.
4.0 5 V
供应
直流 供应 电流 5 10 毫安
uvlo 门槛 电压 V
UVLO
V
CC
rising. 6.5 6.9 7.3V
uvlo hysteresis 0.7 0.9 1.1V
1
所有 限制 在 温度 extremes are 有保证的 通过 correlation使用 标准 statistical 质量 控制 (sqc).
2
有保证的 用 设计, 不 测试 在 生产.
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